參數(shù)資料
型號(hào)： TMS320LC545
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： Digital Signal Processors(20/25ns指令周期， 高性能，大并行度，特殊指令集可有效實(shí)現(xiàn)多種復(fù)雜算法及應(yīng)用的DSP)
中文描述： 數(shù)字信號(hào)處理器（20/25ns指令周期，高性能，大并行度，特殊指令集可有效實(shí)現(xiàn)多種復(fù)雜算法及應(yīng)用的數(shù)字信號(hào)處理器）
文件頁數(shù)： 51/107頁
文件大?。?/td> 2149K
代理商： TMS320LC545
TMS320C54x, TMS320LC54x
FIXED-POINT DIGITAL SIGNAL PROCESSORS
SPRS039A – FEBRUARY 1996 – REVISED JULY 1997
48
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
Table 13. TMS320C54x/TMS320LC54x Instruction Set Opcodes (Continued)
MNEMONIC SYNTAX
OPCODE
CYCLES
DESCRIPTION
LSB
MSB
WORDS/
LOAD/STORE INSTRUCTIONS (CONTINUED)
STH
src
ASM
, Smem
Shift ACC high by ASM, store to data memory
1/1
1000
011S
IAAA
AAAA
STH
src SHFT Xmem
Shift ACC high, then store to data memory
1/1
1001
101S
XXXX
SHFT
STH
src[, SHIFT ], Smem
Shift ACC high, then store to data memory
(2-word opcode)
2/2
0110
0000
1111
110S
IAAA
011S
AAAA
HIFT
ST
src Ymem
|| ADD
Xmem dst
Store ACC with parallel add
1/1
1100
00SD
XXXX
YYYY
ST
src Ymem
|| LD
Xmem dst
Store ACC with parallel load into accumulator
1/1
1100
10SD
XXXX
YYYY
ST
src Ymem
|| LD
Xmem
T
Store ACC with parallel load into TREG
1/1
1110
01S0
XXXX
YYYY
ST
src Ymem
|| MAC
[
R
]
Xmem dst
Parallel store and multiply ACC [round]
1/1
1101
0RSD
XXXX
YYYY
ST
src Ymem
|| MAS
[
R
]
Xmem dst
Parallel store, multiply, and subtract
1/1
1101
1RSD
XXXX
YYYY
ST
src Ymem
|| MPY
Xmem dst
Parallel store and multiply
1/1
1100
11SD
XXXX
YYYY
ST
src Ymem
|| SUB
Xmem dst
Parallel store and subtract
1/1
1100
01SD
XXXX
YYYY
STL
src Smem
Store ACC low to data memory
1/1
1000
000S
IAAA
AAAA
STL
src
ASM
, Smem
Shift ACC low by ASM, store to data memory
1/1
1000
010S
IAAA
AAAA
STL
src SHFT Xmem
Shift ACC low, then store to data memory
1/1
1001
100S
XXXX
SHFT
STL
src[, SHIFT, Smem
Shift ACC low, then store to data memory
(2-word opcode)
2/2
0110
0000
1111
110S
IAAA
100S
AAAA
HIFT
STLM
src MMR
Store accumulator low to memory
1/1
1000
100S
IAAA
AAAA
STM
#lk MMR
Store ACC low into memory-mapped register
2/2
0111
0111
IAAA
AAAA
STRCD
Xmem cond
Store TREG conditionally
1/1
1001
1100
XXXX
COND
LOGICAL INSTRUCTIONS
AND
Smem src
AND single data-memory operand with ACC
1/1
0001
100S
IAAA
AAAA
AND
#lk[, SHFT , src[, dst ]
Shift long-immediate operand, AND with ACC
2/2
1111
00SD
0011
SHFT
AND
#lk
16
, src[, dst ]
Shift long-immediate 16 bits, AND with ACC
2/2
1111
00SD
0110
0011
AND
src[, SHIFT], [, dst ]
AND accumulator(s), then shift result
1/1
1111
00SD
100S
HIFT
ANDM
#lk Smem
AND memory with long-immediate operand
2/2
0110
1000
IAAA
AAAA
BIT
Xmem BITC
Test bit
1/1
1001
0110
XXXX
BITC
BITF
Smem #lk
Test bit field specified by immediate value
2/2
0110
0001
IAAA
AAAA
BITT
Smem
Test bit specified by TREG
1/1
0011
0100
IAAA
AAAA
CMPL
src[, dst ]
Complement accumulator
1/1
1111
01SD
1001
0011
CMPM
Smem #lk
Compare memory with long-immediate operand
2/2
0110
0000
IAAA
AAAA
CMPR
CC ARx
Compare auxiliary register with AR0
1/1
1111
01CC
1010
1ARX
OR
Smem, src
Values for words and cycles assume the use of DARAM for data. Add one word and one cycle when using long-offset indirect addressing or
absolute addressing with a single data-memory operand.
Delayed Instruction
§Condition true
Condition false
OR single data-memory operand with ACC
1/1
0001
101S
IAAA
AAAA
A
instruction set summary (continued)
相關(guān)PDF資料
PDF描述
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