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參數(shù)資料
| 型號： | TDAT042G51A-3BLL1 |
| 英文描述： | TDAT SONET/SDH 155/622/2488 Mbits/s Data Interfaces |
| 中文描述： | TDAT的SONET / SDH 155/622/2488 Mbits /秒數(shù)據(jù)接口 |
| 文件頁數(shù)： | 266/310頁 |
| 文件大小： | 4628K |
| 代理商： | TDAT042G51A-3BLL1 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁當(dāng)前第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁第307頁第308頁第309頁第310頁
238
Agere Systems Inc.
Data Sheet
May 2001
155/622/2488 Mbits/s Data Interface
TDAT042G5 SONET/SDH
Register Descriptions
(continued)
DE Registers
(continued)
Table 139. Registers 0x1100
—
0x1107: ATM/HDLC/SDL Framer
—
Condition Counter 1 (PMRST Update) (RO)
Reset default of registers = 0x0000.
Address
(Hex)
1100
—
1107
Bit #
Name
Function
Reset Default
—
PM_FC1_[0
—
3][27:0]
ATM/HDLC/SDL Counter 1
Channel [0
—
3].
Keeps a count of
conditions detected by the data framer in the
particular channel. This register can
represent only one of the following based
upon the channel
’
s payload type:
I
HDLC invalid sequences (as defined in
IETF RFC 1622 below)
I
ATM corrected cells
I
SDL corrected header
This value is updated upon assertion of
PMRST, and the real-time counter value is
reset to zero.
From IETF RFC 1622, invalid sequences are
the following:
1. Frames which are too short (less than 4
data bytes). See register PM_FC2_0
(addresses 0x1108
—
0x110F).
2. Frames which end with a control escape
octet followed immediately by a coding flag
sequence (0x7D7E).
3. Frames in which octet framing is violated
by transmitting a 0 stop bit where a 1 bit is
expected.
Reserved.
These bits must be written to
their reset default value (0x0).
[11:4] is the MSByte of PM_FC1_0.
[7:0] is the LSByte of PM_FC1_0.
Reserved.
These bits must be written to
their reset default value (0x0).
[11:4] is the MSByte PM_FC1_1.
[7:0] is the LSByte of PM_FC1_1.
Reserved.
These bits must be written to
their reset default value (0x0).
[11:4] is the MSByte of PM_FC1_2.
[7:0] is the LSByte of PM_FC1_2.
Reserved.
These bits must be written to
their reset default value (0x0).
[11:4] is the MSByte of PM_FC1_3.
[7:0] is the LSByte of PM_FC1_3.
0x0000
1100
15
—
12
—
0x0
11
—
0
15
—
0
15
—
12
PM_FC1_0[27:16]
PM_FC1_0[15:0]
—
0x000
0x0000
0x0
1101
1102
11
—
0
15
—
0
15
—
12
PM_FC1_1[27:16]
PM_FC1_1[15:0]
—
0x000
0x0000
0x0
1103
1104
11
—
0
15
—
0
15
—
12
PM_FC1_2[27:16]
PM_FC1_2[15:0]
—
0x000
0x0000
0x0
1105
1106
11
—
0
15
—
0
PM_FC1_3[27:16]
PM_FC1_3[15:0]
0x000
0x0000
1107
相關(guān)PDF資料 |
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