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參數(shù)資料
| 型號： | TDAT042G51A-3BLL1 |
| 英文描述： | TDAT SONET/SDH 155/622/2488 Mbits/s Data Interfaces |
| 中文描述： | TDAT的SONET / SDH 155/622/2488 Mbits /秒數(shù)據(jù)接口 |
| 文件頁數(shù)： | 230/310頁 |
| 文件大小： | 4628K |
| 代理商： | TDAT042G51A-3BLL1 |
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202
Agere Systems Inc.
Data Sheet
May 2001
155/622/2488 Mbits/s Data Interface
TDAT042G5 SONET/SDH
Register Descriptions
(continued)
PT Registers
(continued)
Table 103. Registers 0x0AA6
—
0x0AAD, 0x0AAE, 0x0AB5, 0x0AB6
—
0x0ABD, 0x0ABE
—
0x0AC5: PT Con-
trol Parameters (R/W)
(continued)
Reset default of registers 0x0AA6, 0x0AAE, 0x0AB6, 0x0ABE = 0xF200.
Reset default of registers 0x0AA7, 0x0AAF, 0x0AB7, 0x0ABF = 0x0000.
Reset default of registers 0x0AA8, 0x0AB0, 0x0AB8, 0x0AC0 = 0x0FFF.
Reset default of registers 0x0AA9, 0x0AB1, 0x0AB9, 0x0AC1 = 0x0000.
Reset default of registers 0x0AAA, 0x0AB2, 0x0ABA, 0x0AC2 = 0x0000.
Reset default of registers 0x0AAB, 0x0AB3, 0x0ABB, 0x0AC3 = 0x1AAA.
Reset default of registers 0x0AAC, 0x0AB4, 0x0ABC, 0x0AC4 = 0x3AAA.
Reset default of registers 0x0AAD, 0x0AB5, 0x0ABD, 0x0AC5 = 0x3333.
Address
(Hex)
0AAA, 0AB2,
0ABA, 0AC2
Bit #
Name
Function
Reset
Default
0
7
TRDIP_UNEQUIPINH
[A
—
D]
Transmit RDI-P UNEQUIP Inhibit.
Control bit,
when set, causes the UNEQUIP failure to not
contribute to RDI-P generation.
Transmit RDI-P LOP-P Inhibit.
Control bit,
when set, causes the LOP-P failure to not
contribute to RDI-P generation.
Transmit RDI-P AIS-P Inhibit.
Control bit,
when set, causes the AIS-P failure to not
contribute to RDI-P generation.
6
TRDIP_LOPPINH[A
—
D]
0
5
TRDIP_AISINH[A
—
D]
0
4
TRDIP_ENH_OR1B[A
—
D]
Transmit RDI-P Enhanced or 1-Bit
Monitoring.
Control bit, when set, causes
enhanced failure code insert to occur on the
G1[3:1] bits; otherwise, inserts a single bit
failure code into G1[3].
TREIPERRINS[A
—
D]
Transmit REI-P Error Insert.
Control bit, when
set, causes an error to be continuously injected
into the G1[7:4] bits.
TB3ERRINS[A
—
D]
Transmit B3 Error Insert.
Control bit, when
set, causes the B3 value to be inverted.
TJ1SINS[A
—
D]
Transmit J1 Software Insert.
Control bit, when
set, causes the J1 byte stored in the
TJ1DINS[A
—
D][1
—
64][7:0] register to be
injected into the outgoing J1 byte; otherwise,
inserts 0x00 into the J1 byte.
—
Reserved.
This bit must be written to its reset
default value (0).
0
3
0
2
0
1
0
0
0
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