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List of Tables
vi
September 2004
SLES120
3
5 Power-Down Timing
3
6 Error Recovery Timing
3
7 Mute Timing
3
8 HP_SEL Timing
3
9 I
2
S Format 64 Fs Format
3
10 Left Justified 64 Fs Format
3
11 Right Justified 64 Fs Format
4
1 Typical I
2
C Sequence
4
2 Single Byte Write Transfer
4
3 Multiple Byte Write Transfer
4
4 Single Byte Read Transfer
4
5 Multiple Byte Read Transfer
39
40
40
41
42
43
44
45
46
46
47
47
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List of Tables
Title
Table
1
1 Serial Data Formats
1
2 TAS5028A Audio Processing Feature Sets
1
3 Bass and Treble Filter Selections
1
4 Linear Gain Step Size
2
1 Device Outputs During Reset
2
2 Values Set During Reset
2
3 Device Outputs During Power Down
2
4 Device Outputs During Backend Error
2
5 Description of the Channel Configuration Registers (0x05 to 0x0C)
2
6 Recommended TAS5028A Configurations for Texas Instruments Power Stages
2
7 Audio System Configuration (General Control Register 0xE0)
2
8 Volume Ramp Rates in ms
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2
9 Inter-Channel Delay Default Values
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6
1 Clock Control Register
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6
2 General Status Register (0x01)
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6
3 Error Status Register (0X02)
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6
4 System Control Register 1
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6
5 System Control Register 2
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6
6 Channel Configuration Control Registers
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6
7 Headphone Configuration Control Register
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6
8 Serial Data Interface Control Register Format
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6
9 Soft Mute Register
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6
10 Automute Control Register
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6
11 Automute PWM Threshold and Backend Reset Period
6
12 Modulation Index Limit Register
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6
13 Interchannel Channel Delay Registers
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6
14 Channel Offset Register
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6
15 Bank Switching Command
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6
16 Input Mixer Registers Format (0x41 – 0x48, Channels 1
8)
6
17 Bass and Treble Bypass Register Format (0x89
0x90)
6
18 Output Mixer Control Register Format (Upper 4 Bytes)
Page
9
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11
19
19
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29
30
31
31
53
53
53
54
54
54
55
55
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58
58
59
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63
63
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