參數(shù)資料
型號： ST162552
廠商： Exar Corporation
英文描述： DUAL ASYNCHRONOUS RECEIVER/TRANSMITTER WITH FIFOs
中文描述： 雙異步接收器/發(fā)送器與FIFO的
文件頁數(shù)： 6/28頁
文件大?。?/td> 121K
代理商： ST162552
3-140
ST16C2552
S
ST16C2552 ACCESSIBLE REGISTERS A/B
A2 A1 A0
Register
BIT-7
BIT-6
BIT-5
BIT-4
BIT-3
BIT-2
BIT-1
BIT-0
0 0 0
RHR
bit-7
bit-6
bit-5
bit-4
bit-3
bit-2
bit-1
bit-0
0 0 0
THR
bit-7
bit-6
bit-5
bit-4
bit-3
bit-2
bit-1
bit-0
0 0 1
IER
0
0
0
0
modem
status
interrupt
receive
line
status
interrupt
transmit receive
holding
register
holding
register
0 1 0
FCR
RCVR
trigger
MSB)
RCVR
trigger
(LSB)
0
0
DMA
mode
select
XMIT
FIFO
reset
RCVR
FIFO
reset
FIFO
enable
0 1 0
ISR
0/
0/
0
0
int
int
int
int
FIFOs
enabled enabled
FIFOs
priority
bit-2
priority
bit-1
priority
bit-0
status
0 1 1
LCR
divisor
latch
enable
set
break
set
parity
even
parity
parity
enable
stop
bits
word
length
bit-1
word
length
bit-0
1 0 0
MCR
0
0
0
loop
back
OP2*
OP1*
RTS*
DTR*
1 0 1
LSR
0/
trans.
empty
trans.
holding interrupt
empty
break
framing
error
parity
error
overrun
error
receive
data
ready
FIFO
error
1 1 0
MSR
CD
RI
DSR
CTS
delta
CD*
delta
RI*
delta
DSR*
delta
CTS*
1 1 1
SPR
bit-7
bit-6
bit-5
bit-4
bit-3
bit-2
bit-1
bit-0
0 0 0
DLL
bit-7
bit-6
bit-5
bit-4
bit-3
bit-2
bit-1
bit-0
0 0 1
DLM
bit-15
bit-14
bit-13
bit-12
bit-11
bit-10
bit-9
bit-8
0 1 0
AFR
0
0
0
0
0
MF*
sel-1
MF*
sel-0
SP
write
These registers are accessible only when LCR bit-7 is set to “1”.
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PDF描述
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