參數(shù)資料
型號： SDA9206
廠商： SIEMENS A G
元件分類： 模擬信號調(diào)理
英文描述： ADC with Built in Antialiasing filter and Clock generation UnitS
中文描述： SPECIALTY ANALOG CIRCUIT, PQFP64
封裝： PLASTIC, MQFP-64
文件頁數(shù)： 53/54頁
文件大?。?/td> 255K
代理商： SDA9206
SDA 9206
Semiconductor Group
53
1999-02-10
5.3
Programmable Data Output Delay:
DAT_OUT: Pins PAQ7...0, PBQ7...0, BLN, HS, H1I1, H2I2 and VS
Figure 23
The delay times are valid for a clock rate of the analog PLL of 27 MHz.
DATDEL
000
001
t
QH
; min.
6 ns
10 ns
t
QD
; max.
25 ns
29 ns
Data valid
Data valid
t
QD
t
QH
CLK1
DAT_OUT
UET10469
T
Data not valid
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PDF描述
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SDR3005ZS 30A 80nsec 400 to 600 V Ultrafast Rectifier
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