參數(shù)資料
型號(hào)： SDA9206
廠商： SIEMENS A G
元件分類： 模擬信號(hào)調(diào)理
英文描述： ADC with Built in Antialiasing filter and Clock generation UnitS
中文描述： SPECIALTY ANALOG CIRCUIT, PQFP64
封裝： PLASTIC, MQFP-64
文件頁數(shù)： 20/54頁
文件大?。?/td> 255K
代理商： SDA9206
SDA 9206
Semiconductor Group
20
1999-02-10
2.2.1
Straight binary or Two’s complement output coding is selectable for each separate signal
component (Y and UV) via
I
2
C-Bus control bits YCODE and UVCODE.
For straight binary coding a special suppression of code 0 and code 255 is provided in
output format mode according CCIR 656.
Output Coding for Straight Binary / Two’s Complement Mode
Table 1
Output Coding
V
CY
,
V
CU, V
: ext. clamping level during clamping at
C
ext cl
on channel AINY
resp. AINU, AINV
Table 1
is valid for
V
REFL
= 2.2 V and
V
REFH
= 4.2 V, xAMP = 0000
Step
AINY
AINU, AINV
OFL
Bit
UFL
Bit
Straight
Binary
7654 3210
0000 0000
0000 0000
0000 0001
0000 0010
1111 1101
1111 1110
1111 1111
1111 1111
Two’s
Complement
7654 3210
1000 0000
1000 0000
1000 0001
1000 0010
0111 1101
0111 1110
0111 1111
0111 1111
Underflow
0
1
2
253
254
255
Overflow
<
V
CY
- 0.125 V
V
CY
- 0.125 V
V
CY
- 0.117 V
V
CY
- 0.109 V
V
CY
+ 1.859 V
V
CY
+ 1.867 V
V
CY
+ 1.875 V
>
V
CY
+ 1.875 V
<
V
CU, V
- 1.0 V
V
CU, V
- 1.0 V
V
CU, V
- 0.992 V
V
CU, V
- 0.984 V
V
CU, V
+ 0.984 V
V
CU, V
+ 0.992 V
V
CU, V
+ 1.0 V
>
V
CU, V
+ 1.0 V
0
0
0
0
0
0
0
1
1
0
0
0
0
0
0
0
相關(guān)PDF資料
PDF描述
SDA9270 ICs for Consumer Electronics
SDA9290-6 Picture Processor
SDR3005MTX 30A 80nsec 400 to 600 V Ultrafast Rectifier
SDR3005MTXV 30A 80nsec 400 to 600 V Ultrafast Rectifier
SDR3005ZS 30A 80nsec 400 to 600 V Ultrafast Rectifier
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