- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄296800 > PEF22508E (INFINEON TECHNOLOGIES AG) DATACOM, PCM TRANSCEIVER, PBGA256 PDF資料下載
參數(shù)資料
| 型號： | PEF22508E |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PBGA256 |
| 封裝： | 17 X 17 MM, 1 MM PITCH, PLASTIC, LBGA-256 |
| 文件頁數(shù)： | 175/193頁 |
| 文件大?。?/td> | 10683K |
| 代理商： | PEF22508E |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁當前第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁
OctalLIU
TM
PEF 22508 E
Functional Description
Data Sheet
82
Rev. 1.0, 2005-06-02
3.11.4
Local Loop
The local loop-back is activated by
The control bit LIM0.LL (LIM0).
After detection of the appropriate In-band loop code, if enabled by ALS.SILS, see Chapter 3.11.2.
The local loop-back mode disconnects the receive lines RL1/2 or ROID from the receiver. Instead of the signals
coming from the line the data provided by the framer interface is routed through the analog receiver back to the
framer interface. However, the bit stream is transmitted undisturbed on the line at XL1/2. However, an AIS to the
distant end can be enabled by setting MR1.XAIS = 1 without influencing the data looped back to the framer
interface.
The signal codes for transmitter and receiver have to be identical.
Figure 37
Local Loop
3.11.5
Payload Loop-Back
The payload loop-back is activated by setting MR2.PLB (MR2).
During activated payload loop-back the data stream is looped from the receiver section back to transmitter section.
The looped data passes the complete receiver including the wander and jitter compensation in the receive elastic
buffer and is output on pin RDO. Instead of the data an AIS signal (MR2.SAIS) can be sent to the framer interface.
If the PLB is enabled the transmitter and the data on pins XL1/2 or XDOP/XDON are clocked with FCLKR instead
of FCLKX. All the received data is processed normally.
OctalLIU_local_loop
Equalizer
Clock &
Data
Recovery
Decoder
RDOP
RCLK
RL1/ROID
RL2
DCO-R
Dual Receive Elastic Buffer
Receive Line
Interface
DPLL
A
D
J
internal
receive clock
RDON
C
Pulse
Shaper,
LBO
Encoder
XDIP
XL2
DCO-X
Dual Transmit Elastic Buffer
Transmit Line
Interface
DAC
XL1
G
H
E
F
%
TCLK
FCLKX
recovered
receive clock
internal
transmit
clock
XL4
XL3
XDIN
Local Loop
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PEF22554E | DATACOM, FRAMER, PBGA160 |
| PEF22554HT | DATACOM, FRAMER, PQFP144 |
| PES12-42S-N0024 | |
| PESD3V3V4UK,132 | 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE |
| PF38F3050L0YUQ3A | SPECIALTY MEMORY CIRCUIT, PBGA88 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PEF22508EV1.1-G | 功能描述:網(wǎng)絡控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| PEF22508EV11G | 制造商:Rochester Electronics LLC 功能描述: 制造商:Infineon Technologies AG 功能描述: |
| PEF22508EV11GXP | 制造商:Lantiq 功能描述:LINE INTERFACE UNITS |
| PEF22508EV11GXT | 制造商:Lantiq 功能描述:LINE INTERFACE UNITS |
| PEF22509EV1.1 | 制造商:Infineon Technologies AG 功能描述:SP000205605_T/E ASIC_TY_PB |
發(fā)布緊急采購，3分鐘左右您將得到回復。