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參數(shù)資料
| 型號： | PEF22508E |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PBGA256 |
| 封裝： | 17 X 17 MM, 1 MM PITCH, PLASTIC, LBGA-256 |
| 文件頁數(shù)： | 170/193頁 |
| 文件大?。?/td> | 10683K |
| 代理商： | PEF22508E |
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OctalLIU
TM
PEF 22508 E
Functional Description
Data Sheet
78
Rev. 1.0, 2005-06-02
3.10
Framer Interface
The framer interface of the OctalLIU
TM is shown in Figure 35.
Figure 35
Framer Interface (shown for one channel)
Configuring of the framer interface consists on
Configuration of the interface mode (single/dual rail)
Configuration of the multi function ports, see Chapter 3.12
Selection of dual or single rail mode can be done in receive and transmit direction independent from each other.
In single rail mode of the receive direction (LIM3.DRR = 0, LIM3), the unipolar data is supported at RDOP and
the bipolar violation (BPV) is supported at the receive multifunction pins. Therefore one of the three receive
multifunction pins must be configured to RDON/BPV output (for example PC3.RPX3(3:0) = 1110
B), seeTable 29,
if BPV output is used exernally.
If dual rail mode is selected in receive direction by setting of register bit LIM3.DRR, the positive rail of the data is
supported at RDOP and the negative rail of the data or is supported at the receive multi function pins. Therefore
one of the three receive multifunction pins must be configured to RDON/BPV output, seeTable 29.
Clocking of RDOP and RDON/BPV is done with the rising or falling edge of the internal receive clock, selected by
DIC3.RESR. The internal receive clock can be sourced either
By the receive clock RCLK of the receive system (CMR2.IRSC = 1, CMR2). To support the framer with these
clock FCLKR output pin function must be selected by PC5.CSRP = 1 (PC5). or
Receive
Framer
Interface
Transmit
Framer
Interface
Transmit System
(see chapter 3.8.)
FCLKR
RP(A...C)
FCLKX
XP(A...B)
XDIP
TCLK
XCLK
Receive System
(see chapter 3.6)
FCLKX
internal
transmit
clock
Dual Transmit
Eastic Buffer
RCLK
Dual Receive
Elastic Buffer
LOS
RDON/BPV
RCLK
XDIN
Multi Function
Ports
Multi Function
Ports
OctalLIU_framer_if
internal
receive clock
K
J: controlled by CMR2.IRSC and DIC1.RBS(1:0)
K: controlled by CMR2.IXSC
1: Input/output selection of FCLKR by PC5.CSRP
RDON/BPV
LOS
RDOP
J
XDIN
XDIP
recovered
clock
from
DCO-R
1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PEF22554E | DATACOM, FRAMER, PBGA160 |
| PEF22554HT | DATACOM, FRAMER, PQFP144 |
| PES12-42S-N0024 | |
| PESD3V3V4UK,132 | 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE |
| PF38F3050L0YUQ3A | SPECIALTY MEMORY CIRCUIT, PBGA88 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PEF22508EV1.1-G | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| PEF22508EV11G | 制造商:Rochester Electronics LLC 功能描述: 制造商:Infineon Technologies AG 功能描述: |
| PEF22508EV11GXP | 制造商:Lantiq 功能描述:LINE INTERFACE UNITS |
| PEF22508EV11GXT | 制造商:Lantiq 功能描述:LINE INTERFACE UNITS |
| PEF22509EV1.1 | 制造商:Infineon Technologies AG 功能描述:SP000205605_T/E ASIC_TY_PB |
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