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參數(shù)資料
| 型號(hào)： | PEF22508E |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PBGA256 |
| 封裝： | 17 X 17 MM, 1 MM PITCH, PLASTIC, LBGA-256 |
| 文件頁(yè)數(shù)： | 131/193頁(yè) |
| 文件大?。?/td> | 10683K |
| 代理商： | PEF22508E |
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OctalLIU
TM
PEF 22508 E
Functional Description
Data Sheet
42
Rev. 1.0, 2005-06-02
3.4
Block Diagram
Figure 5 shows the block diagram of the OctalLIU
TM.
Figure 5
Block Diagram
3.5
Functional Blocks
The four possible micro controller interface modes - two asynchronous modes (Intel, Motorola) and two serial
interface modes (SPI bus or SCI bus) - are selected by using the interface mode selection pins IM(1:0). This
selection is valid immediately after reset becomes inactive.
After changing of the interface mode by IM(1:0), a hardware reset must be applied.
3.5.1
Asynchronous Micro Controller Interface (Intel or Motorola mode)
The asychronous micro controller interface is selected if IM(1:0) is strapped to 00B (Intel mode) or 01B
(Motorola mode).
An handshake signal (data acknowledge DTACK for Motorola- and READY for Intel-mode) is provided indicating
successful read or write cycle. By using DTACK or READY respectively no counter is necessary in the micro
controller to finish the access, see also timing diagrams Figure 43 ff.
The generation of READY is asynchronous:
In Intel mode read access READY will be set to low by the OctalLIU
TM after the data output is stable at the
OctalLIU
TM. After the rising edge of RD (which is driven by the micro controller), READY is low for a “hold time”,
before it will be set to high by the OctalLIU
TM.
In the Intel mode write access READY will be set to low by the OctalLIU
TM after the falling edge of WR (which is
driven by the micro controller). After WR is high and data are written successfully into the registers of the
OctalLIU
TM, READY will be set to high by the OctalLIUTM.
Long+Short
Haul Receive
Line Interface
Long+Short
Haul Transmit
Line Interface
Clock &Data
Recovery
Loc
al
L
oop
R
em
ot
eLoo
p
+
JA
T
LineDecoder
PRBS Monitor
Dual Receive
Elastic Buffer
Dual Transmit
Elastic Buffer
Transmit
Jitter Attunator
Receive
Jitter Attunator
MUX
Receive
Framer
Interface
Transmit
Framer
Interface
FCLKX(1:8)
TCLK
RCLK
XDI(1:8)
XPA(1:8)
XPB(1:8)
RPA(1:8)
RPB(1:8)
RPC(1:8)
RDO(1:8)
FCLKR(1:8)
XL1/XOID(1:8)
XL2(1:8)
RL1/ROID(1:8)
RL2(1:8)
1
…
8
Boundary Scan
JTAG
Asynchronous Micro
Controller Interface
SPI Interface
SCI Interface
Master Clocking
Unit
MCLK SYNC FSC
TDI,TMS,TCK,TRS,TDO
D(15:0)
A(10:0)
CS
WR/RW
RD/DS
BHE/BLE
ALE
DBW
RES
INT
READY/TDACK
IM(1:0)
XL3(1:8)
XL4(1:8)
RLS(1:8)
LineEncoder
PRBS Gener.
IBLMonitor
IBLGenerator
OctalLIU_blockdiagram
P
ay
load
L
oo
p
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PEF22554E | DATACOM, FRAMER, PBGA160 |
| PEF22554HT | DATACOM, FRAMER, PQFP144 |
| PES12-42S-N0024 | |
| PESD3V3V4UK,132 | 25 W, UNIDIRECTIONAL, 4 ELEMENT, SILICON, TVS DIODE |
| PF38F3050L0YUQ3A | SPECIALTY MEMORY CIRCUIT, PBGA88 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PEF22508EV1.1-G | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC T/E RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| PEF22508EV11G | 制造商:Rochester Electronics LLC 功能描述: 制造商:Infineon Technologies AG 功能描述: |
| PEF22508EV11GXP | 制造商:Lantiq 功能描述:LINE INTERFACE UNITS |
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