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參數(shù)資料
| 型號： | PC56F8006VWL |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 61/106頁 |
| 文件大小： | 0K |
| 描述： | DSP 16BIT 28-SOIC |
| 標(biāo)準(zhǔn)包裝： | 26 |
| 系列： | 56F8xxx |
| 核心處理器： | 56800 |
| 芯體尺寸： | 16-位 |
| 速度： | 32MHz |
| 連通性： | I²C，LIN，SCI，SPI |
| 外圍設(shè)備： | LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 23 |
| 程序存儲器容量： | 16KB（8K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1K x 16 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 15x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 28-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 管件 |
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MC56F8006/MC56F8002 Digital Signal Controller, Rev. 4
Specifications
Freescale Semiconductor
58
Tri-stated, when a bus or signal is placed in a high impedance state
Data Valid state, when a signal level has reached VOL or VOH
Data Invalid state, when a signal level is in transition between VOL and VOH
Figure 26. Signal States
8.13.1
Serial Peripheral Interface (SPI) Timing
Table 29. SPI Timing1
Characteristic
Symbol
Min
Max
Unit
See Figure
Cycle time
Master
Slave
tC
125
62.5
—
ns
Enable lead time
Master
Slave
tELD
—
31
—
ns
Enable lag time
Master
Slave
tELG
—
125
—
ns
Clock (SCK) high time
Master
Slave
tCH
50
31
—
ns
Clock (SCK) low time
Master
Slave
tCL
50
31
—
ns
Data set-up time required for inputs
Master
Slave
tDS
20
0
—
ns
Data hold time required for inputs
Master
Slave
tDH
0
2
—
ns
Access time (time to data active from high-impedance
state)
Slave
tA
4.8
15
ns
Disable time (hold time to high-impedance state)
Slave
tD
3.7
15.2
ns
Data Invalid State
Data1
Data3 Valid
Data2
Data3
Data1 Valid
Data Active
Data2 Valid
Data
Three-stated
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| PCA8575BS,118 | IC I/O EXPANDER I2C 16B 24HVQFN |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| PC56F8025VLD | 制造商:Freescale Semiconductor 功能描述:16-BIT 56F8XXX CISC 32KB FLASH 3.3V 44-PIN LQFP TRAY - Trays |
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