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參數(shù)資料
| 型號(hào)： | PC56F8006VWL |
| 廠商： | Freescale Semiconductor |
| 文件頁(yè)數(shù)： | 48/106頁(yè) |
| 文件大小： | 0K |
| 描述： | DSP 16BIT 28-SOIC |
| 標(biāo)準(zhǔn)包裝： | 26 |
| 系列： | 56F8xxx |
| 核心處理器： | 56800 |
| 芯體尺寸： | 16-位 |
| 速度： | 32MHz |
| 連通性： | I²C，LIN，SCI，SPI |
| 外圍設(shè)備： | LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 23 |
| 程序存儲(chǔ)器容量： | 16KB（8K x 16） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 1K x 16 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 15x12b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 28-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 管件 |
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MC56F8006/MC56F8002 Digital Signal Controller, Rev. 4
Specifications
Freescale Semiconductor
46
8.5
DC Electrical Characteristics
This section includes information about power supply requirements and I/O pin characteristics.
Table 19. Recommended Operating Conditions
(VREFL x= 0 V, VSSA = 0 V, VSS = 0 V)
Characteristic
Symbol
Notes
Min
Typ
Max
Unit
Supply voltage
VDD, VDDA
33.3
3.6
V
Voltage difference VDD to VDDA
V
DD
–0.1
0
0.1
V
Voltage difference VSS to VSSA
V
SS
–0.1
0
0.1
V
Device Clock Frequency
Using relaxation oscillator
Using external clock source
FSYSCLK
1
0
32
MHz
Input Voltage High (digital inputs)
VIH
Pin Groups 1, 2
2.0
VDD
V
Input Voltage Low (digital inputs)
VIL
Pin Groups 1, 2
–0.3
0.8
V
Oscillator Input Voltage High
XTAL driven by an external clock source
VIHOSC
Pin Group 4
2.0
VDDA + 0.3
V
Oscillator Input Voltage Low
VILOSC
Pin Group 4
–0.3
0.8
V
Output Source Current High at VOH min.)
1
When programmed for low drive strength
When programmed for high drive strength
1 Total chip source or sink current cannot exceed 75 mA.
IOH
Pin Group 1
—
–4
–8
mA
Output Source Current Low (at VOL max.)
1
When programmed for low drive strength
When programmed for high drive strength
IOL
Pin Groups 1, 2
—
4
8
mA
Ambient Operating Temperature (Extended
Industrial)
TA
–40
105
°C
Flash Endurance
(Program Erase Cycles)
NF
TA = –40°C to 125°C
10,000
—
cycles
Flash Data Retention
tR
TJ 85°C avg
15
—
years
Flash Data Retention with <100
Program/Erase Cycles
tFLRET
TJ 85°C avg
20
—
years
Table 20. Default Mode
Pin Group 1
GPIO, TDI, TDO, TMS, TCK
Pin Group 2
SCL, SDA
Pin Group 3
ADC and Comparator
Analog Inputs and PGA
Inputs
Pin Group 4
XTAL, EXTAL
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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