- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄383734 > P9S12XEP100J1MAAR (飛思卡爾半導(dǎo)體(中國(guó))有限公司) Microcontrollers PDF資料下載
參數(shù)資料
| 型號(hào)： | P9S12XEP100J1MAAR |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁(yè)數(shù)： | 951/1036頁(yè) |
| 文件大?。?/td> | 3356K |
| 代理商： | P9S12XEP100J1MAAR |
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Appendix A Electrical Characteristics
MC9S12XE-Family Reference Manual Rev. 1.07
Freescale Semiconductor
951
A.6.3
Phase Locked Loop
A.6.3.1
Jitter Information
With each transition of the clock f
cmp
, the deviation from the reference clock f
ref
is measured and input
voltage to the VCO is adjusted accordingly.The adjustment is done continuously with no abrupt changes
in the clock output frequency. Noise, voltage, temperature and other factors cause slight variations in the
control loop resulting in a clock jitter. This jitter affects the real minimum and maximum clock periods as
illustrated in
Figure A-5
.
Figure A-5. Jitter Definitions
Therelativedeviationoft
nom
isatitsmaximumforoneclockperiod,anddecreasestowardszeroforlarger
number of clock periods (N).
Defining the jitter as:
For N < 100, the following equation is a good fit for the maximum jitter:
Figure A-6. Maximum bus clock jitter approximation
2
3
N-1
N
1
0
t
nom
t
max1
t
min1
t
maxN
t
minN
J N
max 1
tmaxN
N tnom
----------------------
–
1
tminN
N tnom
----------------------
–
,
=
1
5
10
20
N
J(N)
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| P9S12XEP100J1MAG | Microcontrollers |
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