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參數(shù)資料
| 型號： | P9S12XEP100J1MAAR |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 505/1036頁 |
| 文件大?。?/td> | 3356K |
| 代理商： | P9S12XEP100J1MAAR |
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Chapter 11 S12XE Clocks and Reset Generator (S12XECRGV1) Block Description
MC9S12XE-Family Reference Manual Rev. 1.07
Freescale Semiconductor
505
TheinternalresetoftheMCUremainsassertedwhiletheresetgeneratorcompletesthe192SYSCLKlong
reset sequence. In case the RESET pin is externally driven low for more than these 192 SYSCLK cycles
(External Reset), the internal reset remains asserted longer.
Figure 11-21. RESET Timing
11.5.1.1
Clock Monitor Reset
The S12XECRG generates a Clock Monitor Reset in case all of the following conditions are true:
Clock monitor is enabled (CME = 1)
Loss of clock is detected
Self-Clock Mode is disabled (SCME = 0).
The reset event asynchronously forces the configuration registers to their default settings. In detail the
CME and the SCME are reset to logical ‘1’ (which changes the state of the SCME bit. As a consequence
the S12XECRG immediately enters Self Clock Mode and starts its internal reset sequence. In parallel the
clock quality check starts. As soon as clock quality check indicates a valid Oscillator Clock the
S12XECRGswitchestoOSCCLKandleavesSelfClockMode.Sincetheclockqualitycheckerisrunning
in parallel to the reset generator, the S12XECRG may leave Self Clock Mode while still completing the
internal reset sequence.
11.5.1.2
Computer Operating Properly Watchdog (COP) Reset
When COP is enabled, the S12XECRG expects sequential write of $55 and $AA (in this order) to the
ARMCOPregisterduringtheselectedtime-outperiod.Oncethisisdone,theCOPtime-outperiodrestarts.
If the program fails to do this the S12XECRG will generate a reset.
) (
) (
)
(
)
SYSCLK
128+
n
cycles
with
n
being
min 3 / max 6
cycles depending
on internal
synchronization
delay
64 cycles
ICRG drives RESET pin low
possibly
SYSCLK
not
running
possibly
RESET
driven low
externally
)
(
(
RESET
RESET pin
released
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| P9S12XEP100J1MAG | Microcontrollers |
| P9S12XEP100J1MAGR | Microcontrollers |
| P9S12XEP100J1MAL | Microcontrollers |
| P9S12XEP100J1MALR | Microcontrollers |
| P9S12XEP100J1MVL | Microcontrollers |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| P9S12XEP100J1MAG | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P9S12XEP100J1MAGR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P9S12XEP100J1MAL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P9S12XEP100J1MALR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P9S12XEP100J1MVL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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