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參數(shù)資料
| 型號(hào)： | MPC5553MVR132 |
| 廠商： | Freescale Semiconductor |
| 文件頁(yè)數(shù)： | 20/68頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | MCU 1.5MB FLASH 132MHZ 416-PBGA |
| 標(biāo)準(zhǔn)包裝： | 200 |
| 系列： | MPC55xx Qorivva |
| 核心處理器： | e200z6 |
| 芯體尺寸： | 32-位 |
| 速度： | 132MHz |
| 連通性： | CAN，EBI/EMI，以太網(wǎng)，SCI，SPI |
| 外圍設(shè)備： | DMA，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 220 |
| 程序存儲(chǔ)器容量： | 1.5MB（1.5M x 8） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 64K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.35 V ~ 1.65 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 40x12b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 416-BBGA |
| 包裝： | 托盤 |
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Electrical Characteristics
MPC5553 Microcontroller Data Sheet, Rev. 4
Freescale Semiconductor
27
Figure 4. Pad Output Delay
3.13
AC Timing
3.13.1
Reset and Configuration Pin Timing
3 The output delay, and the rise and fall, are calculated to 20% or 80% of the respective signal.
4 The output delay is shown in Figure 4. To calculate the output delay with respect to the system clock, add a maximum of one
system clock to the output delay.
5 This parameter is guaranteed by characterization rather than 100% tested.
Table 19. Reset and Configuration Pin Timing 1
1 Reset timing specified at: V
DDEH = 3.0–5.25 V and TA = TL to TH.
Spec
Characteristic
Symbol
Min.
Max.
Unit
1
RESET pulse width
tRPW
10
—
tCYC
2
RESET glitch detect pulse width
tGPW
2—
tCYC
3
PLLCFG, BOOTCFG, WKPCFG, RSTCFG setup time to RSTOUT valid
tRCSU
10
—
tCYC
4
PLLCFG, BOOTCFG, WKPCFG, RSTCFG hold time from RSTOUT valid
tRCH
0—
tCYC
VDD 2
VOH
VOL
Rising-edge
out delay
Falling-edge
Pad
internal data
Pad
output
out delay
input signal
相關(guān)PDF資料 |
PDF描述 |
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