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參數(shù)資料
| 型號(hào)： | MFRC50001T |
| 廠商： | NXP Semiconductors N.V. |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Highly integrated ISO-IEC 14443 A reader IC |
| 封裝： | MFRC50001T/0FE<SOT287-1 (SO32)|<<http://www.nxp.com/packages/SOT287-1.html<1<week 15, 2005,; |
| 文件頁數(shù)： | 61/110頁 |
| 文件大?。?/td> | 841K |
| 代理商： | MFRC50001T |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁當(dāng)前第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁
MFRC500_33
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NXP B.V. 2010. All rights reserved.
Product data sheet
PUBLIC
Rev. 3.3 — 15 March 2010
048033
61 of 110
NXP Semiconductors
MFRC500
Highly Integrated ISO/IEC 14443 A Reader IC
10.5.6
Page 5: FIFO, timer and IRQ pin configuration
10.5.6.1
Page register
Selects the page register; see
Section 10.5.1.1 “Page register” on page 43
.
10.5.6.2
FIFOLevel register
Defines the levels for FIFO underflow and overflow warning.
Table 105. FIFOLevel register (address: 29h) reset value: 0000 1000b, 08h bit allocation
Bit
7
6
5
Symbol
00
Access
R/W
Table 106. FIFOLevel register bit descriptions
Bit
Symbol
7 to 6 00
5 to 0 WaterLevel[5:0] defines, the warning level of a FIFO buffer overflow or underflow:
HiAlert is set to logic 1 if the remaining FIFO buffer space is equal to,
or less than, WaterLevel[5:0] bits in the FIFO buffer.
LoAlert is set to logic 1 if equal to, or less than, WaterLevel[5:0] bits in
the FIFO buffer.
10.5.6.3
TimerClock register
Selects the divider for the timer clock.
Table 107. TimerClock register (address: 2Ah) reset value: 0000 0111b, 07h bit allocation
Bit
7
6
5
Symbol
00
TAutoRestart
Access
RW
RW
Table 108. TimerClock register bit descriptions
Bit
Symbol
7 to 6
00
5
TAutoRestart
4
3
2
1
0
WaterLevel[5:0]
R/W
Description
these values must not be changed
4
3
2
1
0
TPreScaler[4:0]
RW
Value
0
1
Function
these values must not be changed
the timer automatically restarts its countdown from the
TReloadValue[7:0] instead of counting down to zero
the timer decrements to zero and register InterruptIRq
TimerIRq bit is set to logic 1
defines the timer clock frequency (f
TimerClock
). The
TPreScaler[4:0] can be adjusted from 0 to 21. The following
formula is used to calculate the TimerClock frequency
(f
TimerClock
):
f
TimerClock
= 13.56 MHz / 2
TPreScaler
[MHz]
0
4 to 0
TPreScaler[4:0]
-
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PDF描述 |
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