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參數(shù)資料
| 型號： | MCIMX507CVM8B |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA400 |
| 封裝： | 17 X 17 MM, 0.5 MM PITCH, ROHS COMPLIANT, PLASTIC, MABGA-400 |
| 文件頁數(shù)： | 90/120頁 |
| 文件大小： | 1980K |
| 代理商： | MCIMX507CVM8B |
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Electrical Characteristics
i.MX50 Applications Processors for Consumer Products, Rev. 0
Freescale Semiconductor
71
4.9.2
CSPI and eCSPI Timing Parameters
This section describes the timing parameters of the CSPI and eCSPI modules. The CSPI and eCSPI have
separate timing parameters for master and slave modes. The nomenclature used with the CSPI/eCSPI
modules and the respective routing of these signals is shown in Table 46.
4.9.2.1
CSPI Master Mode Timing
characteristics.
Figure 32. CSPI Master Mode Timing Diagram
Table 46. CSPI Nomenclature and Routing
Module
I/O Access
eCSPI1
GPIO, KPP, DISP0_DAT, CSI0_DAT, and EIM_D through IOMUX
eCSPI2
DISP0_DAT, CSI0_DAT, and EIM through IOMUX
CSPI
DISP0_DAT, EIM_A/D, SD1, and SD2 through IOMUX
Table 47. CSPI Master Mode Timing Parameters
ID
Parameter
Symbol
Min
Max
Unit
CS1
CSPIx_CLK Cycle Time
tclk
60
—
ns
CS2
CSPIx_CLK High or Low Time
tSW
6—
ns
CS3
CSPIx_CLK Rise or Fall
tRISE/FALL
——
ns
CS4
CSPIx_CS_x pulse width
tCSLH
15
—
ns
CS5
CSPIx_CS_x Lead Time (CS setup time)
tSCS
5—
ns
CS6
CSPIx_CS_x Lag Time (CS hold time)
tHCS
5—
ns
CS7
CSPIx_DO Setup Time
tSmosi
5—
ns
CS8
CSPIx_DO Hold Time
tHmosi
5—
ns
CS1
CS7 CS8
CS2
CS4
CS6
CS5
CS9 CS10
CSPIx_CLK
CSPIx_CS_x
CSPIx_DO
CSPIx_DI
CSPIx_DRYN1
CS11
CS3
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