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參數(shù)資料
| 型號(hào)： | MCIMX507CVM8B |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA400 |
| 封裝： | 17 X 17 MM, 0.5 MM PITCH, ROHS COMPLIANT, PLASTIC, MABGA-400 |
| 文件頁數(shù)： | 87/120頁 |
| 文件大?。?/td> | 1980K |
| 代理商： | MCIMX507CVM8B |
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Electrical Characteristics
i.MX50 Applications Processors for Consumer Products, Rev. 0
Freescale Semiconductor
69
NOTE
The DDR15,16 could be adjusted by the parameter “DLL_WR_DELAY”;
The ideal case is that SDQS is center aligned to the DRAM_D data valid
window;
For this table, HW_DRAM_PHY15[14:8] (DLL_WR_DELAY) = 0x10;
Table 44. DDR Output AC Timing
ID
Description
Symbol
Min
Max
Unit
DDR10
Positive DQS latching edge to associated CK edge
tDQSS
-0.3
0.3
ns
DDR11
DQS falling edge from CK rising edge—hold time
tDSH
0.5 tCK
- 0.3
0.5 tCK
+ 0.3
ns
DDR12
DQS falling edge to CK rising edge—setup time
tDSS
0.5 tCK
- 0.3
0.5 tCK
+ 0.3
ns
DDR13
DQS output high pulse width
tDQSH
0.48 tCK
0.52 tCK
ns
DDR14
DQS output low pulse width
tDQSL
0.48 tCK
0.52 tCK
ns
DDR15
CK >= 200 MHz
DQ & DQM output setup time relative to DQS
tDS
0.5 tCK
- 1.3
—ns
DDR16
CK >= 200 MHz
DQ & DQM output hold time relative to DQS
tDH
0.5 tCK
- 1.3
—ns
DDR15
CK < 200 MHz
DQ & DQM output setup time relative to DQS
tDS
1
—
ns
DDR16
CK < 200 MHz
DQ & DQM output hold time relative to DQS
tDH
1
—
ns
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