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參數(shù)資料
| 型號： | MCIMX507CVM8B |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA400 |
| 封裝： | 17 X 17 MM, 0.5 MM PITCH, ROHS COMPLIANT, PLASTIC, MABGA-400 |
| 文件頁數(shù)： | 78/120頁 |
| 文件大?。?/td> | 1980K |
| 代理商： | MCIMX507CVM8B |
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i.MX50 Applications Processors for Consumer Products, Rev. 0
60
Freescale Semiconductor
Electrical Characteristics
4.7.2
Examples of EIM Accesses
Figure 19, Figure 20, Figure 21, Figure 22, Figure 23, and Figure 24 give a few examples of basic EIM
accesses to external memory devices with the timing parameters mentioned previously for specific control
parameters settings.
Figure 19. Synchronous Memory Read Access, WSC=1
1 t is axi_clk cycle time. The maximum allowed axi_clk frequency is 133 MHz, whereas the maximum allowed EIM_BCLK
frequency is 66.5 MHz. As a result, if BCD = 0, axi_clk must be
≤ 66.5 MHz. If BCD = 1, then 133 MHz is allowed for axi_clk,
resulting in a EIM_BCLK of 66.5 MHz. When the clock branch to EIM is decreased to 66.5 MHz, other buses are impacted
which are clocked from this source. See the CCM chapter of the MCIMX50 Applications Processor Reference Manual
(MCIMX50RM) for a detailed clock tree description.
2 EIM_BCLK parameters are being measured from the 50% point that is, high is defined as 50% of signal value and low is
defined as 50% as signal value.
3 For signal measurements High is defined as 80% of signal value and Low is defined as 20% of signal value.
Last Valid Address
Address v1
D(v1)
EIM_BCLK
EIM_ADDR
EIM_DATA
EIM_RW
EIM_LBA
EIM_OE
EIM_EBx
EIM_CSx
Next Address
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WE19
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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