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參數(shù)資料
| 型號(hào)： | MC68302CFC20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | RISC PROCESSOR, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁(yè)數(shù)： | 216/480頁(yè) |
| 文件大?。?/td> | 1815K |
| 代理商： | MC68302CFC20 |
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Communications Processor (CP)
4-96
MC68302 USER’S MANUAL
MOTOROLA
R—Ready
0 = This buffer is not currently ready for transmission. The user is free to manipulate
this BD (or its associated buffer). The CP clears this bit after the buffer has been
fully transmitted or after an error condition has been encountered.
1 = The data buffer has been prepared for transmission by the user (but not yet trans-
mitted). No fields of this BD may be written by the user once this bit is set.
X—External Buffer
0 = The buffer associated with this BD is in internal dual-port RAM.
1 = The buffer associated with this BD is in external memory.
W—Wrap (Final BD in Table)
0 = This is not the last BD in the Tx BD table.
1 = This is the last BD in the Tx BD table. After this buffer has been used, the CP will
transmit data from the first BD in the table.
NOTE
The user is required to set the wrap bit in one of the first eight
BDs; otherwise, errant behavior may occur.
I—Interrupt
0= No interrupt is generated after this buffer has been serviced.
1= Either TX or TXE in the BISYNC event register will be set when this buffer has been
serviced by the CP, which can cause an interrupt.
L—Last in Message
0 = The last character in the buffer is not the last character in the current block.
1 = The last character in the buffer is the last character in the current block. The trans-
mitter will enter (remain in) normal mode after sending the last character in the buff-
er and the BCS (if enabled).
TB—Transmit BCS
This bit is valid only when the L bit is set.
0 = Transmit the SYN1–SYN2 sequence or IDLE (according to the SYNF bit in the BI-
SYNC mode register) after the last character in the buffer.
1 = Transmit the BCS sequence after the last character. The BISYNC controller will
also reset the BCS generator after transmitting the BCS sequence.
B—BCS Enable
0 = Buffer consists of characters to be excluded from the BCS accumulation.
1 = Buffer consists of characters to be included in the BCS accumulation.
BR—BCS Reset
0 = The BCS accumulation is not reset.
1 = The transmitter BCS accumulation is reset (used for STX or SOH) before sending
the data buffer.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| MC68302CRC20 | Integrated Multiprotocol Processor User’s Manual |
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| MC6802 | Microprocessor With Clock and Oprtional RAM |
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參數(shù)描述 |
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| MC68302CFE16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| MC68302CFE20 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| MC68302CPV16VC | 功能描述:IC MPU NETWORK 16MHZ 144-LQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標(biāo)準(zhǔn)包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點(diǎn):- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤 |
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