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參數(shù)資料
| 型號： | MC68302CFC20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | RISC PROCESSOR, PQFP132 |
| 封裝： | PLASTIC, QFP-132 |
| 文件頁數(shù)： | 118/480頁 |
| 文件大?。?/td> | 1815K |
| 代理商： | MC68302CFC20 |
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System Integration Block (SIB)
3-68
MC68302 USER’S MANUAL
MOTOROLA
3.10.4 Initialization
The user should first initialize the refresh routine parameters in the SCC2 parameter RAM.
These parameters are the DRAM low starting address, the DRAM high starting address, the
DRAM address increment step (number of bytes in a row), the count (number of rows), and
a temporary count. Then, mask the PB8 bit in the IMR (unless an interrupt is desired on each
refresh request). Next, the timer or baud rate generator should be programmed to provide
the desired refresh clock to the PB8 pin. Next, the ERRE bit in the SCR should be set. Then,
upon every high-to-low transition of PB8, the refresh routine executes one refresh (read) cy-
cle.
ERRE—External RISC Request Enable
0 = Normal operation.
1 = When this bit is set, a high-to-low transition on PB8 causes the CP to execute the
DRAM refresh routine.
3.10.5 DRAM Refresh Memory Map
The DRAM refresh memory map replaces the SCC2 TxBD6 and TxBD7 structures in the
parameter RAM. The wrap bit must therefore be set in SCC2 TxBD5 so that only six TxBDs
are used for SCC2. These parameters should be written before the DRAM refresh controller
receives its first request, but may be read at any time. They are undefined at reset.
#
Initialized by the user (M68000 core).
DRAM_High—Dynamic RAM High Address and Function Codes
This 16-bit parameter contains the dynamic RAM address space function code output during
the refresh cycle and the high eight bits of the dynamic RAM starting address. This param-
eter should be initialized by the user before activating the refresh routine.
NOTE
The FC bits should not be programmed to the value “111.”
Table 3-11. DRAM Refresh Memory Map Table
Address
Name
Width
Word
Word
Word
Word
Word
Word
Word
Word
Description
Base + 570 #
DRAM-High
DRAM-Low
INCREMENT
COUNT
T-ptr-H
T-ptr-L
T-count
RESERVED
Dynamic RAM High Address and FC
Dynamic RAM Low Address
Increment Step (number of bytes/row)
RAM Refresh Cycle Count (number of rows)
Temporary Refresh High Address and FC
Temporary Refresh Low Address
Temporary Refresh Cycles Count
Reserved
Base + 572 #
Base + 574 #
Base + 576 #
Base + 578
Base + 57A
Base + 57C #
Base + 57E
15
0
14
12
11
8
7
0
FC
0 0 0
HIGH START ADDRESS
相關PDF資料 |
PDF描述 |
|---|---|
| MC68302CRC16 | Integrated Multiprotocol Processor User’s Manual |
| MC68302CRC20 | Integrated Multiprotocol Processor User’s Manual |
| MC68302RC16 | Integrated Multiprotocol Processor User’s Manual |
| MC6802 | Microprocessor With Clock and Oprtional RAM |
| MC68B02P | Microprocessor With Clock and Oprtional RAM |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68302CFC20C | 制造商:Motorola 功能描述:68302 |
| MC68302CFE16 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| MC68302CFE20 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Communications Controller |
| MC68302CPV16VC | 功能描述:IC MPU NETWORK 16MHZ 144-LQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標準包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點:- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應商設備封裝:357-PBGA（25x25） 包裝:托盤 |
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