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參數(shù)資料
| 型號： | ISPLSI3448 |
| 廠商： | Lattice Semiconductor Corporation |
| 英文描述： | In-System Programmable High Density PLD |
| 中文描述： | 在系統(tǒng)可編程高密度可編程邏輯器件 |
| 文件頁數(shù)： | 9/14頁 |
| 文件大?。?/td> | 144K |
| 代理商： | ISPLSI3448 |
Specifications
ispLSI 3448
9
ispLSI 3448 Timing Model
Derivations of
t
su,
t
h and
t
co from the Product Term Clock
1
=
=
=
=
(2.3 + 3.2 + 5.0) + (1.5) - (2.3 + 3.2 + 3.7)
=
=
=
=
(2.3 + 3.2 + 3.7) + (5.4) - (2.3 + 3.2 + 5.0)
4.1 ns
t
su
Logic + Reg su - Clock (min)
(
t
iobp +
t
grp +
t
20ptxor) + (
t
gsu) - (
t
iobp +
t
grp +
t
ptck(min))
(#24+ #30+ #35) + (#38) - (#24+ #30+ #44)
t
h
Clock (max) + Reg h - Logic
(
t
iobp +
t
grp +
t
ptck(max)) + (
t
gh) - (
t
iobp +
t
grp +
t
20ptxor)
(#24+ #30+ #44) + (#39) - (#24+ #30+ #35)
=
=
=
=
t
co
Clock (max) + Reg co + Output
(
t
iobp +
t
grp +
t
ptck(max)) + (
t
gco) + (
t
orp +
t
ob)
(#24 + #30 + #44) + (#40) + (#45 + #47)
(2.3 + 3.2 + 3.7) + (0.5) + (1.5 + 2.5)
Table 2-0042/3448
2.8 ns
13.7 ns
GLB Reg
Delay
I/O
(Output)
ORP
Delay
Feedback
4 PT Bypass
#33
20 PT
XOR Delays
Control
PTs
#42 - 44
Input
RST
I/O
(Input)
Y0,1,2
Y3,4
D
Q
GRP
#30
GLB Reg Bypass
#37
ORP Bypass
#46
D
Q
RST
RE
OE
CK
I/O Reg Bypass
#24
I/O Cell
ORP
GLB
GRP
I/O Cell
#25 - 29
#32
#31
#34 - 36
#51
#54
#55
#45
Reset
#52
#53
#53
#38 - 41
#49, 50
#47, 48
GOE0,1
TOE
0902/3448
Note: Calculations are based on timing specs for the ispLSI 3448-90L.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ISPLSI5128VE | In-System Programmable 3.3V SuperWIDE High Density PLD |
| ISPLSI5128VE-80LT128I | In-System Programmable 3.3V SuperWIDE High Density PLD |
| ISPLSI5128VE-100LT128 | In-System Programmable 3.3V SuperWIDE High Density PLD |
| ISPLSI5128VE-100LT128I | In-System Programmable 3.3V SuperWIDE High Density PLD |
| ISPLSI5128VE-125LT128 | In-System Programmable 3.3V SuperWIDE High Density PLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ISPLSI-3448-70LB432 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Lattice Semiconductor Corporation 功能描述: |
| ISPLSI-3448-90LB432 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Lattice Semiconductor Corporation 功能描述: |
| ISPLSI5128VE-100LT128 | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| ISPLSI5128VE-100LT128I | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| ISPLSI5128VE-125LT128 | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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