參數(shù)資料
型號： ISP1161
廠商： NXP Semiconductors N.V.
英文描述： Full-speed Universal Serial Bus single-chip host and device controller
中文描述： 全速通用串行總線的單芯片主機(jī)和設(shè)備控制器
文件頁數(shù)： 112/127頁
文件大小： 2762K
代理商： ISP1161
Philips Semiconductors
ISP1161
Full-speed USB single-chip host and device controller
Product data
Rev. 01 — 3 July 2001
112 of 130
9397 750 08313
Philips Electronics N.V. 2001. All rights reserved.
20.3 DMA interface timing
20.3.1
HC single-cycle burst mode DMA timing
[1]
t
RHAL
+ t
DS
+ t
ALRL
.
Table 117:Dynamic characteristics: HC single-cycle burst mode DMA timing
Symbol
Parameter
Conditions
16-bit bus
Min
Unit
Max
Read/write timing
t
RL
t
RLDV
t
RHDZ
t
WSU
t
WHD
t
AHRH
t
ALRL
t
DC
t
SHAH
t
RHAL
t
DS
RD pulse width
read process data setup time
read process data hold time
write process data setup time
write process data hold time
DACK1 HIGH to DREQ1 HIGH
DACK1 LOW to DREQ1 LOW
DREQ1 cycle
RD/WR HIGH to DACK1 HIGH
DREQ1 HIGH to DACK1 LOW
DREQ1 pulse spacing
33
26
0
5
0
62 to 81
-
-
-
-
-
-
-
21
-
-
-
-
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
[1]
> 0
> 0
125 to 146
Fig 46. HC single-cycle burst mode DMA timing.
MGT970
DREQ1
DACK1
D[15:0]
(read)
D[15:0]
(write)
RD or WR
tDS
tAHRH
tDC
data
valid
data
valid
tALRL
tRHAL
tWHD
tWSU
tRLDV
tRHDZ
tSHAH
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PDF描述
ISP1161A1 Universal Serial Bus single-chip host and device controller
ISP1161A1BD Universal Serial Bus single-chip host and device controller
ISP1161A1BM Universal Serial Bus single-chip host and device controller
ISP1161BD Full-speed Universal Serial Bus single-chip host and device controller
ISP1161BM Full-speed Universal Serial Bus single-chip host and device controller
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