參數(shù)資料
型號： HW-V5-ML561-UNI-G-J
廠商： Xilinx Inc
文件頁數(shù)： 44/91頁
文件大小： 0K
描述： EVALUATION PLATFORM VIRTEX-5
產(chǎn)品變化通告： Development Systems Discontinuation 16/Jan/2012
標(biāo)準(zhǔn)包裝： 1
系列： Virtex®-5 LXT
類型： FPGA
適用于相關(guān)產(chǎn)品： XC5VLX50T-FFG1136
所含物品： 評估平臺，線纜，CD，小型閃存卡，DDR2 DIMM，- 不包括電源 -
Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
49
TDSPCCK_CEMM/TDSPCKC_CEMM
CEM input to M register CLK
0.25
0.18
0.29
0.21
0.36
0.26
ns
TDSPCCK_CEPP/TDSPCKC_CEPP
CEP input to P register CLK
0.56
0.01
0.63
0.01
0.73
0.01
ns
Setup and Hold Times of the RST Pins
TDSPCCK_{RSTAA, RSTBB}/
TDSPCKC_{RSTAA, RSTBB}
{RSTA, RSTB} input to {A, B} register
CLK
0.24
0.23
0.28
0.26
0.33
0.31
ns
TDSPCCK_RSTCC/ TDSPCKC_RSTCC
RSTC input to C register CLK
0.19
0.17
0.21
0.26
0.28
ns
TDSPCCK_RSTMM/ TDSPCKC_RSTMM
RSTM input to M register CLK
0.25
0.18
0.29
0.21
0.36
0.26
ns
TDSPCCK_RSTPP/TDSPCKC_RSTPP
RSTP input to P register CLK
0.56
0.01
0.63
0.01
0.73
0.01
ns
Combinatorial Delays from Input Pins to Output Pins
TDSPDO_{AP, ACRYOUT, BP, BCRYOUT}_M
{A, B} input to {P, CARRYOUT} output
using multiplier
2.78
3.22
3.84
ns
TDSPDO_{AP, ACRYOUT, BP, BCRYOUT}_NM
{A, B} input to {P, CARRYOUT} output
not using multiplier
1.59
1.77
2.22
ns
TDSPDO_{CP, CCRYOUT, CRYINP, CRYINCRYOUT}
{C, CARRYIN} input to
{P, CARRYOUT} output
1.50
1.67
2.08
ns
Combinatorial Delays from Input Pins to Cascading Output Pins
TDSPDO_{AACOUT, BBCOUT}
{A, B} input to
{ACOUT, BCOUT} output
1.00
1.12
1.31
ns
TDSPDO_{APCOUT, ACRYCOUT, AMULTSIGNOUT,
BPCOUT, BCRYCOUT, BMULTSIGNOUT}_M
{A, B} input to {PCOUT,
CARRYCASCOUT, MULTSIGNOUT}
output using multiplier
2.78
3.22
3.84
ns
TDSPDO_{APCOUT, ACRYCOUT, AMULTSIGNOUT,
BPCOUT, BCRYCOUT, BMULTSIGNOUT}_NM
{A, B} input to {PCOUT,
CARRYCASCOUT, MULTSIGNOUT}
output not using multiplier
1.72
1.92
2.42
ns
TDSPDO_{CPCOUT, CCRYCOUT, CMULTSIGNOUT,
CRYINPCOUT, CRYINCRYCOUT,
CRYINMULTSIGNOUT}
{C, CARRYIN} input to {PCOUT,
CARRYCASCOUT, MULTSIGNOUT}
output
1.63
1.82
2.28
ns
Combinatorial Delays from Cascading Input Pins to All Output Pins
TDSPDO_{ACINP, ACINCRYOUT, BCINP,
BCINCRYOUT}_M
{ACIN, BCIN} input to {P, CARRYOUT}
output using multiplier
2.78
3.22
3.84
ns
TDSPDO_{ACINP, ACINCRYOUT, BCINP,
BCINCRYOUT}_NM
{ACIN, BCIN} input to {P, CARRYOUT}
output not using multiplier
1.59
1.77
2.22
ns
TDSPDO_{ACINACOUT, BCINBCOUT}
{ACIN, BCIN} input to {ACOUT, BCOUT}
output
1.00
1.12
1.31
ns
TDSPDO_{ACINPCOUT, ACINCRYCOUT,
ACINMULTSIGNOUT, BCINPCOUT, BCINCRYCOUT,
BCINMULTSIGNOUT}_M
{ACIN, BCIN} input to {PCOUT,
CARRYCASCOUT, MULTSIGNOUT}
output using multiplier
2.78
3.22
3.84
ns
TDSPDO_{ACINPCOUT, ACINCRYCOUT,
ACINMULTSIGNOUT, BCINPCOUT, BCINCRYCOUT,
BCINMULTSIGNOUT}_NM
{ACIN, BCIN} input to {PCOUT,
CARRYCASCOUT, MULTSIGNOUT}
output not using multiplier
1.72
1.92
2.42
ns
TDSPDO_{PCINP, CRYCINP, MULTSIGNINP,
PCINCRYOUT, CRYCINCRYOUT,
MULTSIGNINCRYOUT}
{PCIN, CARRYCASCIN, MULTSIGNIN}
input to {P, CARRYOUT} output
1.30
1.45
1.82
ns
Table 69: DSP48E Switching Characteristics (Cont’d)
Symbol
Description
Speed
Units
-3
-2
-1
相關(guān)PDF資料
PDF描述
HW-V5-ML550-UNI-G-J EVALUATION PLATFORM VIRTEX-5
HW-V5-ML525-UNI-G-J EVAL PLATFORM ROCKET IO VIRTEX-5
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XE8000EV120 BOARD EVAL FOR SX8722I070TRLF
AD923011-200EBZ BOARD EVAL FOR AD9230 200MSPS
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參數(shù)描述
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HW-VID-KIT 功能描述:可編程邏輯 IC 開發(fā)工具 Lattice Video Interface Kit RoHS:否 制造商:Altera Corporation 產(chǎn)品:Development Kits 類型:FPGA 工具用于評估:5CEFA7F3 接口類型: 工作電源電壓:
HW-VL1 制造商:IDEC CORPORATION 功能描述:BARRIER
HW-VL2 制造商:IDEC Corporation 功能描述:COVER;HW FNGR SAFE CONTAC CVR 制造商:IDEC CORPORATION 功能描述:HW FNGR SAFE CONTAC CVR
HW-VL3 制造商:IDEC Corporation 功能描述: 制造商:IDEC Corporation 功能描述:Replacs TW-VL3 FNGR SAF
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