參數(shù)資料
型號： EP20K60EQC208
廠商： ALTERA CORP
元件分類： PLD
英文描述： LOADABLE PLD, PQFP208
封裝： 30.40 X 30.40 MM, 0.50 MM PITCH, PLASTIC, QFP-208
文件頁數(shù)： 45/114頁
文件大?。?/td> 4116K
代理商： EP20K60EQC208
IGLOO nano DC and Switching Characteristics
2- 22
Advance v0.2
Detailed I/O DC Characteristics
Table 2-26 Input Capacitance
Symbol
Definition
Conditions
Min.
Max.
Units
CIN
Input capacitance
VIN = 0, f = 1.0 MHz
8
pF
CINCLK
Input capacitance on the clock pin
VIN = 0, f = 1.0 MHz
8
pF
Table 2-27 I/O Output Buffer Maximum Resistances 1
Standard
Drive Strength
RPULL-DOWN
(
)2
RPULL-UP
(
)3
3.3 V LVTTL / 3.3V LVCMOS
2 mA
100
300
4 mA
100
300
6 mA
50
150
8 mA
50
150
3.3 V LVCMOS Wide Range
100 A
TBD
2.5 V LVCMOS
2 mA
100
200
4 mA
100
200
6 mA
50
100
8 mA
50
100
1.8 V LVCMOS
2 mA
200
225
4 mA
100
112
1.5 V LVCMOS
2 mA
200
224
1.2 V LVCMOS 4
2 mA
TBD
1.2 V LVCMOS Wide Range 4
100 A
TBD
Notes:
1. These maximum values are provided for informational reasons only. Minimum output buffer resistance
values depend on VCCI, drive strength selection, temperature, and process. For board design considerations
and detailed output buffer resistances, use the corresponding IBIS models located on the Actel website at
2. R(PULL-DOWN-MAX) = (VOLspec) / IOLspec
3. R(PULL-UP-MAX) = (VCCImax – VOHspec) / IOHspec
4. Applicable to IGLOO nano V2 devices operating at VCCI ≥ VCC.
相關(guān)PDF資料
PDF描述
EP20K60EQC240 LOADABLE PLD, PQFP240
EP20K60ERC208 LOADABLE PLD, PQFP208
EP20K60ERC240 LOADABLE PLD, PQFP240
EP20K60ETC144 LOADABLE PLD, PQFP144
EP2645ETTS-33.178MTR CRYSTAL OSCILLATOR, CLOCK, 33.178 MHz, HCMOS OUTPUT
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參數(shù)描述
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EP20K60EQC208-1ES 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA
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