參數(shù)資料
型號(hào)： DS3170+
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 37/230頁(yè)
文件大?。?/td> 0K
描述： IC TXRX DS3/E3 100-CSBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 640
功能： 單芯片收發(fā)器
接口： DS3，E3
電路數(shù)： 1
電源電壓： 3.135 V ~ 3.465 V
電流 - 電源： 120mA
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 100-LBGA，CSBGA
供應(yīng)商設(shè)備封裝： 100-CSBGA（11x11）
包裝： 托盤(pán)
包括： DS3 調(diào)幀器，E3 調(diào)幀器，HDLC 控制器，芯片內(nèi) BERT
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DS3170 DS3/E3 Single-Chip Transceiver
131 of 230
Register Name:
GL.SR
Register Description:
Global Status Register
Register Address:
014h
Bit #
15
14
13
12
11
10
9
8
Name
--
Bit #
7
6
5
4
3
2
1
0
Name
--
CLOL
GPMS
Bit 1 : CLAD Loss of Lock (CLOL) – This bit is set when any of the PLLs in the CLAD are not locked to the
reference frequency.
Bit 0: Global Performance Monitoring Update Status (GPMS) This bit is set when all of the port performance
register update status bits (PORT.SR.PMU), that are enabled for global update control (PORT.CR2.PMUM=1), are
set. It is an “AND” of all the globally enabled port PMU status bits. In global software update mode, the global
update request bit (GL.CR.GPMU) should be held high until this status bit goes high.
0 = The associated update request signal is low or not all register updates are completed
1 = The requested performance register updates are all completed
Register Name:
GL.SRL
Register Description:
Global Status Register Latched
Register Address:
016h
Bit #
15
14
13
12
11
10
9
8
Name
--
Bit #
7
6
5
4
3
2
1
0
Name
--
8KREFL
CLADL
ONESL
CLOLL
GPMSL
Bit 4: 8kHz Reference Activity Status Latched (8KREFL) This bit will be set when the 8 kHz reference signal on
the GPIO4 pin is active. The GL.CR2.G8KIS bit must be set for the activity to be monitored.
Bit 3: CLAD Reference Clock Activity Status Latched (CLADL) This bit will be set when the CLAD PLL
reference clock signal on the REFCLK pin is active.
Bit 2: One Second Status Latched (ONESL) This bit will be set once a second. The GL.ISR.GSR status bit will
be set when this bit is set and the GL.SRIE.ONESIE bit is enabled. The
INT pin will be driven low if this bit is set
and the GL.SRIE.ONESIE bit and the GL.ISRIE.GSRIE bit are enabled.
Bit 1: CLAD Loss Of Lock Latched (CLOLL) This bit will be set when the GL.SR.CLOL status bit changes from
low to high. The GL.ISR.GSR bit will be set when this bit is set and the GL.SRIE.CLOLIE bit is set and the
INT pin
will be driven low if the GL.ISRIE.GSRIE bit is also enabled.
Bit 0: Global Performance Monitoring Update Status Latched (GPMSL) This bit will be set when the
GL.SR.GPMS status bit changes from low to high. This bit will set the GL.ISR.GSR status bit if the
GL.SRIE.GPMSIE is enabled.
This bit will drive the interrupt pin low if the GL.SRIE.GPMSIE bit and the
GL.ISRIE.GSRIE bit are enabled.
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PDF描述
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DS3170+ 功能描述:網(wǎng)絡(luò)控制器與處理器 IC DS3/E3 Single-Chip Transceiver RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3170DK 功能描述:網(wǎng)絡(luò)開(kāi)發(fā)工具 DS3170 Dev Kit RoHS:否 制造商:Rabbit Semiconductor 產(chǎn)品:Development Kits 類型:Ethernet to Wi-Fi Bridges 工具用于評(píng)估:RCM6600W 數(shù)據(jù)速率:20 Mbps, 40 Mbps 接口類型:802.11 b/g, Ethernet 工作電源電壓:3.3 V
DS3170L 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:DS3/E3 Single-Chip Transceiver
DS3170LN 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:DS3/E3 Single-Chip Transceiver
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