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參數(shù)資料
型號： DS3112DK
廠商： Maxim Integrated Products
文件頁數(shù)： 14/133頁
文件大小： 0K
描述： KIT DEMO FOR DS3112
產品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 1
主要目的： 接口，交叉點開關/多路復用器
已用 IC / 零件： DS3112
已供物品： 板，CD
DS3112
110 of 133
13 AC ELECTRICAL CHARACTERISTICS
3
Table 1 -1. AC Characteristics—Low-Speed (T1 and E1) Ports
(VDD = 3.3V ±5%, TA = 0°C to +70°C for DS3112; TA = -40°C to +85°C for DS3112N.)
(See
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
648
ns
1
LRCLK/LRCCLK/LTCLK/LTCCLK
Clock Period
t1
488
ns
2
294
324
354
ns
1
LRCLK Clock High Time
t2
204
244
284
ns
2
LTCLK/LTCCLK/LRCCLK Clock
High Time
t2
100
ns
294
324
354
ns
1
LRCLK Clock Low Time
t3
204
244
284
ns
2
LTCLK/LTCCLK/LRCCLK Clock
Low Time
t3
100
ns
LTDAT Setup Time to the Falling
Edge or Rising Edge of
LTCLK/LTCCLK
t4
50
ns
LTDAT Hold Time from the Falling
Edge or Rising Edge of
LTCLK/LTCCLK
t5
50
ns
Delay from the Rising Edge or
Falling Edge of LRCLK to Data
Valid on LRDAT
t6
50
ns
Delay from the Rising Edge or
Falling Edge of LRCCLK to Data
Valid on LRDAT
t6
100
ns
5
NOTES:
1) T3 mode.
2) E3 mode.
3) In normal mode, LTDAT is sampled on the falling edge of LTCLK/LTCCLK and LRDAT is updated on the
rising edge of LRCLK/LRCCLK.
4)
5)
In inverted mode, LTDAT is sampled on the rising edge of LTCLK/LTCCLK and LRDAT is updated on the
falling edge of LRCLK/LRCCLK.
LRCCLK is enabled. (See Section 4.2 and Figure 1-1, Figure 1-2, and Figure 1-3 for details.)
相關PDF資料
PDF描述
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參數(shù)描述
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DS3112N+ 功能描述:網絡控制器與處理器 IC TEMPE T3/E3 MUX FRMR & M13/E13/G.747 MUX RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
DS3112N+W 功能描述:網絡控制器與處理器 IC TEMPE T3/E3 MUX FRMR & M13/E13/G.747 MUX RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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