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參數(shù)資料
| 型號： | ATNGW100MKII |
| 廠商： | Atmel |
| 文件頁數(shù)： | 198/346頁 |
| 文件大?。?/td> | 0K |
| 描述： | KIT AVR32 NETWORK GATEWAY |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | AVR®32 |
| 類型： | MCU |
| 適用于相關(guān)產(chǎn)品： | AT32AP7000，AT32AP7001，AT32AP7002 |
| 所含物品： | 板 |
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277
2545T–AVR–05/11
ATmega48/88/168
RWWSB by writing the RWWSRE. See “Simple assembly code example for a boot loader” on
page 279 for an example.
27.8.7
Setting the boot loader lock bits by SPM
To set the Boot Loader Lock bits and general lock bits, write the desired data to R0, write
“X0001001” to SPMCSR and execute SPM within four clock cycles after writing SPMCSR.
See Table 27-2 on page 273 and Table 27-3 on page 273 for how the different settings of the
Boot Loader bits affect the Flash access.
If bits 5..0 in R0 are cleared (zero), the corresponding Boot Lock bit and general lock bit will be
programmed if an SPM instruction is executed within four cycles after BLBSET and SELFPR-
GEN are set in SPMCSR. The Z-pointer is don’t care during this operation, but for future
compatibility it is recommended to load the Z-pointer with 0x0001 (same as used for reading the
lO
ck bits). For future compatibility it is also recommended to set bits 7 and 6 in R0 to “1” when
writing the Lock bits. When programming the Lock bits the entire Flash can be read during the
operation.
27.8.8
EEPROM write prevents writing to SPMCSR
Note that an EEPROM write operation will block all software programming to Flash. Reading the
Fuses and Lock bits from software will also be prevented during the EEPROM write operation. It
is recommended that the user checks the status bit (EEPE) in the EECR Register and verifies
that the bit is cleared before writing to the SPMCSR Register.
27.8.9
Reading the fuse and lock bits from software
It is possible to read both the Fuse and Lock bits from software. To read the Lock bits, load the
Z-pointer with 0x0001 and set the BLBSET and SELFPRGEN bits in SPMCSR. When an LPM
instruction is executed within three CPU cycles after the BLBSET and SELFPRGEN bits are set
in SPMCSR, the value of the Lock bits will be loaded in the destination register. The BLBSET
and SELFPRGEN bits will auto-clear upon completion of reading the Lock bits or if no LPM
instruction is executed within three CPU cycles or no SPM instruction is executed within four
CPU cycles. When BLBSET and SELFPRGEN are cleared, LPM will work as described in the
The algorithm for reading the Fuse Low byte is similar to the one described above for reading
the Lock bits. To read the Fuse Low byte, load the Z-pointer with 0x0000 and set the BLBSET
and SELFPRGEN bits in SPMCSR. When an LPM instruction is executed within three cycles
after the BLBSET and SELFPRGEN bits are set in the SPMCSR, the value of the Fuse Low byte
(FLB) will be loaded in the destination register as shown below. Refer to Table 28-5 on page 287
for a detailed description and mapping of the Fuse Low byte.
Similarly, when reading the Fuse High byte, load 0x0003 in the Z-pointer. When an LPM instruc-
tion is executed within three cycles after the BLBSET and SELFPRGEN bits are set in the
SPMCSR, the value of the Fuse High byte (FHB) will be loaded in the destination register as
Bit
76543210
R0
1
BLB12
BLB11
BLB02
BLB01
LB2
LB1
Bit
76543210
Rd
–
BLB12
BLB11
BLB02
BLB01
LB2
LB1
Bit
7
6
5
4
321
0
Rd
FLB7
FLB6
FLB5
FLB4
FLB3
FLB2
FLB1
FLB0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ASPI-1306T-680M-T | INDUCTOR POWER 68UH 1306 SMD |
| DV164136 | DEVELOPMENT KIT FOR PIC18 |
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| 1435863-2 | PATCHCORD CAT6 YLW/YLW BOOT 2' |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| ATN-IC485S | 制造商:MCM 功能描述:COMPUTERS, CONVERTERS CONNECTIVITY; |
| ATO 15 | 制造商:Littelfuse 功能描述:BULK ATO BLADE BOX 15A |
| ATO005 | 制造商:Littelfuse 功能描述: |
| ATO-01001 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:1310nm FP LD To-can |
| ATO-01002 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:1310nm FP LD To-can |
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