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參數(shù)資料
| 型號： | ATAM893T-TKSYD |
| 廠商： | Atmel |
| 文件頁數(shù)： | 31/98頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU FLASH 4K MTP 20SSOP |
| 標準包裝： | 830 |
| 系列： | MARC4 |
| 核心處理器： | MARC4 |
| 芯體尺寸： | 4-位 |
| 速度： | 4MHz |
| 連通性： | SSI（2 線，3 線） |
| 外圍設(shè)備： | 欠壓檢測/復位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 16 |
| 程序存儲器容量： | 4KB（4K x 8） |
| 程序存儲器類型： | EEPROM |
| EEPROM 大小： | 64 x 16 |
| RAM 容量： | 256 x 4 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 6.5 V |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 20-SOIC（0.209"，5.30mm 寬） |
| 包裝： | 管件 |
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4680C–4BMCU–01/05
ATAM893-D
The Timer 2 has a 4-bit compare register (T2CO1) and an 8-bit compare register (T2CO2). Both
these compare registers are cascadable as a 12-bit compare register, or 8-bit compare register
and 4-bit compare register.
For 12-bit compare data value:
m = x +1
0
≤x ≤4095
For 8-bit compare data value:
n = y + 1
0
≤y ≤255
For 4-bit compare data value:
l = z +1
0
≤z ≤15
Figure 5-10. Timer 2
5.3.2.1
Timer 2 Modes
Mode 1: 12-bit Compare Counter
The 4-bit stage and the 8-bit stage work together as a 12-bit compare counter. A compare match
signal of the 4-bit and the 8-bit stage generates the signal for the counter reset, toggle flip-flop or
interrupt. The compare action is programmable via the compare mode register (T2CM). The 4-
bit counter overflow (OVF1) supplies the clock output (POUT) with clocks. The duty cycle gener-
ator (DCG) has to be bypassed in this mode.
Figure 5-11. 12-bit Compare Counter
4-bit Counter 2/1
RES
OVF1
Compare 2/1
T2CO1
CM1
POUT
SSI POUT
CL2/2
DCG
T2M1
P4CR
8-bit Counter 2/2
RES
OVF2
Compare 2/2
T2CO2
T2CM
Control
TOG2
INT4
Bi-phase
Manchester
modulator
OUTPUT
MOUT
M2
to
Modulator 3
T2O
Timer 2
modulator
output-stage
T2M2
SO
Control
SSI
I/O-bus
T2C
CL2/1
T2I
SYSCL
T1OUT
TOG3
SCL
I/O-bus
DCGO
4-bit counter
4-bit compare
RES
4-bit register
CM1
POUT (CL2/1 /16)
8-bit counter
8-bit compare
8-bit register
OVF2
CM2
RES
T2RM
T2OTM
Timer 2
output mode
and T2OTM-bit
T2IM
T2CTM
TOG2
INT4
CL2/1
DCG
T2D1, 0
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