(20% to 80%, V" />
參數(shù)資料
型號： ADSP-21368BBPZ-2A
廠商： Analog Devices Inc
文件頁數(shù)： 48/64頁
文件大?。?/td> 0K
描述： IC DSP 32BIT 333MHZ 256-BGA
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點(diǎn)
接口： DAI，DPI
時鐘速率： 333MHz
非易失內(nèi)存： ROM（768 kB）
芯片上RAM： 256kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.20V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 256-LBGA 裸露焊盤
供應(yīng)商設(shè)備封裝： 256-BGA（27x27）
包裝： 托盤
Rev. F
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October 2013
Figure 43. Typical Output Rise/Fall Time
(20% to 80%, VDDEXT = Min)
Figure 44. Typical Output Rise/Fall Time
(20% to 80%, VDDEXT = Max)
LOAD CAPACITANCE (pF)
12
0
50
100
150
200
250
10
8
6
4
R
IS
E
A
N
D
F
A
L
T
IM
E
S
(n
s
)
2
0
RISE
FALL
y = 0.049x + 1.5105
y=0.0482x + 1.4604
LOAD CAPACITANCE (pF)
8
0
100
250
12
4
2
10
6
R
IS
E
A
N
D
F
A
L
T
IM
E
S
(n
s
)
200
150
50
FALL
y = 0.0467x + 1.6323
y = 0.045x + 1.524
RISE
Figure 45. SDCLK Typical Output Rise/Fall Time
(20% to 80%, VDDEXT = Min)
Figure 46. SDCLK Typical Output Rise/Fall Time
(20% to 80%, VDDEXT = Max)
LOAD CAPACITANCE (pF)
0
50
100
150
200
250
10
8
6
4
R
IS
E
A
N
D
F
A
L
T
IM
E
S
(n
s
)
2
0
RISE
FALL
y= 0.0372x + 0.228
y = 0.0277x + 0.369
LOAD CAPACITANCE (pF)
0
50
100
150
200
250
10
8
6
4
R
IS
E
A
N
D
F
A
L
T
IM
E
S
(n
s
)
2
0
RISE
FALL
y= 0.0364x + 0.197
y = 0.0259x + 0.311
相關(guān)PDF資料
PDF描述
HWS300-24 PWR SUP IND 24V 14A SNG OUTPUT
ADSP-21065LKCAZ264 IC DSP CTLR 32BIT 196CSPBGA
TAJY107M006RNJ CAP TANT 100UF 6.3V 20% 2917
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ABB60DHFD-S578 EDGECARD 120POS PCI32 .050 SMD
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