- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄360656 > 9S12E128DGV1 (Motorola, Inc.) MC9S12E-Family Device User Guide V01.04 PDF資料下載
參數(shù)資料
| 型號(hào)： | 9S12E128DGV1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | MC9S12E-Family Device User Guide V01.04 |
| 中文描述： | MC9S12E -系列設(shè)備的用戶手冊(cè)V01.04 |
| 文件頁數(shù)： | 79/156頁 |
| 文件大?。?/td> | 3077K |
| 代理商： | 9S12E128DGV1 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁當(dāng)前第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁
79
NOTE:
Signals shown in bold are not available in the 80 pin package.
NOTE:
If the port pins are not bonded out in the chosen package the user should initialize the
registers to be inputs with enabled pull resistance to avoid excess current consumption.
This applies to the following pins:
(80QFP): Port A[7:0], Port B[7:0], Port E[6,5,3,2], Port K[7:0], Port U[7:4]
PQ[6:4]
IS[6:4]
—
VDDX
PERQ/
PPSQ
PERQ/
PPSQ
PERS/
PPSS
PERS/
PPSS
PERS/
PPSS
PERS/
PPSS
PERS/
PPSS
PERS/
PPSS
PERS/
PPSS
PERS/
PPSS
PERT/
PPST
PERT/
PPST
PERU/
PPSU
PERU/
PPSU
PERU/
PPSU
Disabled
Port Q I/O Pins, IS[6:4] input
PQ[3:0]
FAULT[3:0]
—
VDDX
Disabled
Port Q I/O Pins, Fault[3:0] input
PS7
SS
—
VDDX
Up
Port S I/O Pin, SPI SS signal
PS6
SCK
—
VDDX
Up
Port S I/O Pin, SPI SCK signal
PS5
MOSI
—
VDDX
Up
Port S I/O Pin, SPI MOSI signal
PS4
MISO
—
VDDX
Up
Port S I/O Pin, SPI MISO signal
PS3
TXD1
—
VDDX
Up
Port S I/O Pin, SCI1 transmit signal
PS2
RXD1
—
VDDX
Up
Port S I/O Pin, SCI1 receive signal
PS1
TXD0
—
VDDX
Up
Port S I/O Pin, SCI0 transmit signal
PS0
RXD0
—
VDDX
Up
Port S I/O Pin, SCI0 receive signal
PT[7:4]
IOC1[7:4]
—
VDDX
Disabled
Port T I/O Pins, timer (TIM1)
PT[3:0]
IOC0[7:4]
—
VDDX
Disabled
Port T I/O Pins, timer (TIM0)
PU[7:6]
—
—
VDDX
Disabled
Port U I/O Pins
PU[5:4]
PW1[5:4]
—
VDDX
Disabled
Port U I/O Pins, PWM outputs
PU[3:0]
IOC2[7:4]
PW1[3:0]
VDDX
Disabled
Port U I/O Pins, timer (TIM2), PWM outputs
NOTES
:
1. The Port E output buffer enable signal control at reset is determined by the PEAR register and is mode dependent. For example,
in special test mode RDWE = LSTRE = 1 which enables the PE[3:2] output buffers and disables the pull-ups. Refer to the S12
MEBI Block Guide for PEAR register details.
Pin Name
Function 1
Pin Name
Function 2
Pin Name
Function 3
Power
Domain
Internal Pull
Resistor
CTRL
Description
Reset State
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 9S12H128 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Microcontroller |
| 9S12H256 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Microcontroller |
| 9S12H256BDGV1 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:9S12H256B Device Guide |
| 9S12HN64 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Microcontroller |
| 9S12HZ128 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:16-bit Microcontroller |
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