參數(shù)資料
型號(hào)： XCCACE-TQG144I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 9/69頁(yè)
文件大小： 0K
描述： IC ACE CONTROLLER CHIP TQ144
產(chǎn)品變化通告： XCCACE-TQG144I Discontinuation 31/Oct/2011
標(biāo)準(zhǔn)包裝： 60
控制器類型： ACE 控制器
電源電壓： 3 V ~ 3.6 V
電流 - 電源： 30mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-TQFP（20x20）
包裝： 管件
其它名稱： 122-1511-5
System ACE CompactFlash Solution
DS080 (v3.0) April 7, 2014
17
Product Specification
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
Data Buffer Read Cycle Ready Timing
When the data buffer is in read mode and the last data word
is read from the buffer, the data buffer ready signal will go
inactive (MPBRDY = LOW) two clock cycles following the
last clock cycle that the output enable is active (MPOE =
LOW). Any attempt to read data out of an “empty” data buf-
fer (MPOE = LOW while MPBRDY = LOW) results in invalid
data. Valid and invalid data buffer reads are shown in
Figure 13: Valid and Invalid Reads From DATABUFREG Data Buffer
50ns
100ns
150ns
200ns
250
CYCLE
CLK
MPA
MPD
MPCE
MPWE
MPOE
MPBRDY
Cycle 0
Cycle 1
Cycle 2
Cycle 3
Cycle 4
Cycle 5
Cycle 6
Cycle 7
DATABUFREG ADDRESS
VALID DATA
INVALID DATA
tSA
tSCE
tSWE
tDD
tDOE
tH
tDOE
tSOE
tH
tSOE
tH
tSA
tDOE
tH
tSOE
tDOE
tH
tSOE
tDD
tDBRDY
tH
DS080_18_020101
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PDF描述
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