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參數(shù)資料
| 型號(hào)： | XC3S400AN-5FTG256C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 103/123頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA SPARTAN-3AN 256FTBGA |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | Spartan®-3AN |
| LAB/CLB數(shù)： | 896 |
| 邏輯元件/單元數(shù)： | 8064 |
| RAM 位總計(jì)： | 368640 |
| 輸入/輸出數(shù)： | 195 |
| 門數(shù)： | 400000 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 256-LBGA |
| 供應(yīng)商設(shè)備封裝： | 256-FTBGA |
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Spartan-3AN FPGA Family: Pinout Descriptions
DS557 (v4.1) April 1, 2011
Product Specification
80
0
N.C.
IO_L14N_0/VREF_0
E7
VREF
0
N.C.
IO_L14P_0
F8
I/O
0
IO_L15N_0
B6
I/O
0
IO_L15P_0
A6
I/O
0
IO_L16N_0
C6
I/O
0
IO_L16P_0
D7
I/O
0
IO_L17N_0
C5
I/O
0
IO_L17P_0
A5
I/O
0
IO_L18N_0
B4
I/O
0
IO_L18P_0
A4
I/O
0
IO_L19N_0
B3
I/O
0
IO_L19P_0
A3
I/O
0
IO_L20N_0/PUDC_B
D5
DUAL
0
IO_L20P_0/VREF_0
C4
VREF
0
IP_0
D6
INPUT
0
IP_0
D12
INPUT
0
IP_0
E6
INPUT
0
IP_0
F7
INPUT
0
IP_0
F9
INPUT
0
IP_0
F10
INPUT
0
IP_0/VREF_0
E9
VREF
0
VCCO_0
B5
VCCO
0
VCCO_0
B9
VCCO
0
VCCO_0
B13
VCCO
0
VCCO_0
E8
VCCO
1
IO_L01N_1/LDC2
N14
DUAL
1
IO_L01P_1/HDC
N13
DUAL
1
IO_L02N_1/LDC0
P15
DUAL
1
IO_L02P_1/LDC1
R15
DUAL
1
IO_L03N_1
IO_L03N_1/A1
N16
DUAL
1
IO_L03P_1
IO_L03P_1/A0
P16
DUAL
1
N.C.
IO_L05N_1/VREF_1
M14
VREF
1
N.C.
IO_L05P_1
M13
I/O
1
N.C.
IO_L06N_1/A3
K13
DUAL
1
N.C.
IO_L06P_1/A2
L13
DUAL
1
N.C.
IO_L07N_1/A5
M16
DUAL
1
N.C.
IO_L07P_1/A4
M15
DUAL
1
N.C.
IO_L08N_1/A7
L16
DUAL
1
N.C.
IO_L08P_1/A6
L14
DUAL
1
IO_L10N_1
IO_L10N_1/A9
J13
DUAL
Table 70: Spartan-3AN FTG256 Pinout (XC3S50AN, XC3S200AN, XC3S400AN) (Cont’d)
Bank
XC3S50AN Pin Name
XC3S200AN/XC3S400AN Pin Name
FTG256 Ball
Type
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PDF描述 |
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