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參數(shù)資料
| 型號(hào)： | UPD77112GC |
| 廠商： | NEC Corp. |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 16-BIT FIXED-POINT DIGITAL SIGNAL PROCESSORS |
| 中文描述： | 16位定點(diǎn)數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 63/80頁(yè) |
| 文件大?。?/td> | 451K |
| 代理商： | UPD77112GC |
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Data Sheet U12801EJ4V0DS00
63
μ
PD77110, 77111, 77112
μ
PD77111, 77112
Serial Interface
Timing requirements
Parameter
Symbol
Condition
MIN.
TYP.
MAX.
Unit
SCK cycle time
t
cSC
60
ns
SCK high-/low-level width
t
wSC
25
ns
SCK rise/fall time
t
rfSC
20
ns
IV
DD
= 1.8 to 2.7 V
10
ns
SOEN setup time
t
suSOE
IV
DD
= 2.3 to 2.7 V
5
ns
IV
DD
= 1.8 to 2.7 V
15
ns
SOEN hold time
t
hSOE
IV
DD
= 2.3 to 2.7 V
10
ns
IV
DD
= 1.8 to 2.7 V
10
ns
SIEN setup time
t
suSIE
IV
DD
= 2.3 to 2.7 V
5
ns
IV
DD
= 1.8 to 2.7 V
15
ns
SIEN hold time
t
hSIE
IV
DD
= 2.3 to 2.7 V
10
ns
IV
DD
= 1.8 to 2.7 V
10
ns
SI setup time
t
suSI
IV
DD
= 2.3 to 2.7 V
5
ns
IV
DD
= 1.8 to 2.7 V
15
ns
SI hold time
t
hSI
IV
DD
= 2.3 to 2.7 V
10
ns
Switching characteristics
Parameter
Symbol
Condition
MIN.
TYP.
MAX.
Unit
IV
DD
= 1.8 to 2.7 V
30
ns
SORQ output delay time
t
dSOR
IV
DD
= 2.3 to 2.7 V
25
ns
SORQ hold time
t
hSOR
0
ns
IV
DD
= 1.8 to 2.7 V
30
ns
SO output delay time
t
dSO
IV
DD
= 2.3 to 2.7 V
25
ns
SO hold time
t
hSO
0
ns
IV
DD
= 1.8 to 2.7 V
30
ns
SIAK output delay time
t
dSIA
IV
DD
= 2.3 to 2.7 V
25
ns
SIAK hold time
t
hSIA
0
ns
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