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參數(shù)資料
| 型號(hào)： | UPD44165094AF5-E40Y-EQ2 |
| 元件分類： | SRAM |
| 英文描述： | 2M X 9 QDR SRAM, 0.45 ns, PBGA165 |
| 封裝： | 13 X 15 MM, PLASTIC, BGA-165 |
| 文件頁數(shù)： | 5/40頁 |
| 文件大小： | 388K |
| 代理商： | UPD44165094AF5-E40Y-EQ2 |
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Data Sheet
M17771EJ3V0DS
μPD44165084A, 44165094A, 44165184A, 44165364A
2. Clock starts before VDD/VDDQ stable
The clock is supplied from a clock generator.
(a)
VDD/VDDQ
DLL#
30 ns. (MIN.)
Clock Stop
VDD/VDDQ Stable (<
±0.1 V DC per 50 ns)
Fix HIGH (or tied to VDDQ)
Unstable Clock
(level, frequency)
Clock
Clock Start
Normal Operation Start
1,024 cycles or more
Stable Clock
(b)
VDD/VDDQ
DLL#
Clock keep running
Switched to HIGH after Clock is stable.
HIGH or LOW
30 ns (MIN.)
DLL# LOW
VDD/VDDQ Stable (<
±0.1 V DC per 50 ns)
Normal
Operation
Start
1,024 cycles or more
Stable Clock
Unstable Clock
(level, frequency)
Clock
Clock Start
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD44325084F5-E50-EQ2-A | 4M X 8 QDR SRAM, 0.45 ns, PBGA165 |
| UPFS120P | P-CHANNEL, Si, SMALL SIGNAL, MOSFET |
| UPL40-U1BT | CABLE TERMINATED, MALE, TNC CONNECTOR, PLUG |
| UPN2AS | FEMALE-FEMALE-MALE, RF Y ADAPTER |
| UPRLED630 | SINGLE COLOR LED, BRIGHT RED, 1.4732 mm |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD44165094BF5-E40-EQ3-A | 制造商:Renesas Electronics Corporation 功能描述:SRAM Chip Sync Dual 1.8V 18M-Bit 2M x 9-Bit 0.45ns 165-Pin BGA |
| UPD44165362BF5-E40-EQ3 | 制造商:Renesas Electronics Corporation 功能描述:UPD44165362BF5-E40-EQ3 - Trays |
| UPD44165362BF5-E40-EQ3-A | 制造商:Renesas Electronics Corporation 功能描述:SRAM Chip Sync Dual 1.8V 18M-Bit 512K x 36 0.45ns 165-Pin BGA |
| UPD44321182GF-A50(A) | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD44324182BF5-E40-FQ1-A | 制造商:Renesas Electronics Corporation 功能描述:RENUPD44324182BF5-E40-FQ1-A 36M-BIT(2M-W |
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