參數(shù)資料
型號： TMS320VC5409PGE100
廠商： Texas Instruments
文件頁數(shù)： 42/93頁
文件大小： 0K
描述： IC DIG SIG PROCESSOR 144-LQFP
標(biāo)準(zhǔn)包裝： 60
系列： TMS320C54x
類型： 定點
接口： 主機接口，McBSP
時鐘速率： 100MHz
非易失內(nèi)存： ROM（32 kB）
芯片上RAM： 64kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.80V
工作溫度： -40°C ~ 100°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
配用： 296-31413-ND - XDS560 CLASS HIGH SPEED EMULATOR
296-23043-ND - BLACKHAWK XDS560 USB EMULATOR
296-15829-ND - DSP STARTER KIT FOR TMS320C5416
其它名稱： 296-10764
296-10764-5
296-10764-5-ND
Functional Overview
47
April 1999 Revised October 2008
SPRS082F
The bits of the interrupt flag register (IFR) and interrupt mask register (IMR) are arranged as shown in
Figure 311. The function of each bit is described in Table 318.
15
14
13
12
11
10
9
8
Reserved
DMAC5
DMAC4
BXINT1/
DMAC3
BRINT1/
DMAC2
HINT
INT3
7
65
43
21
0
BXINT2/
DMAC1
BRINT2/
DMAC0
BXINT0
BRINT0
TINT
INT2
INT1
INT0
LEGEND: R = Read, W = Write, n = value present after reset
Figure 311. IFR and IMR Registers
Table 318. IFR and IMR Register Bit Fields
BIT
FUNCTION
NUMBER
NAME
FUNCTION
1514
Reserved for future expansion
13
DMAC5
DMA channel 5 interrupt flag/mask bit
12
DMAC4
DMA channel 4 interrupt flag/mask bit
11
BXINT1/DMAC3
McBSP1 transmit interrupt flag/mask bit
10
BRINT1/DMAC2
McBSP1 receive interrupt flag/mask bit
9
HINT
Host to 54x interrupt flag/mask
8
INT3
External interrupt 3 flag/mask
7
BXINT2/DMAC1
McBSP2 transmit interrupt flag/mask bit
6
BRINT2/DMAC0
McBSP2 receive interrupt flag/mask bit
5
BXINT0
McBSP0 transmit interrupt flag/mask bit
4
BRINT0
McBSP0 receive interrupt flag/mask bit
3
TINT
Timer interrupt flag/mask bit
2
INT2
External interrupt 2 flag/mask bit
1
INT1
External interrupt 1 flag/mask bit
0
INT0
External interrupt 0 flag/mask bit
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