參數(shù)資料
型號(hào)： TMS320LC17
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： Digital Signal Processors(278ns指令周期，分離的程序和數(shù)據(jù)總線，外部輪詢中斷的DSP)
中文描述： 數(shù)字信號(hào)處理器（278ns指令周期，分離的程序和數(shù)據(jù)總線，外部輪詢中斷的數(shù)字信號(hào)處理器）
文件頁(yè)數(shù)： 122/139頁(yè)
文件大小： 1478K
代理商： TMS320LC17
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RL = 825
,
CL = 100 pF,
(see Figure 2)
RL = 825
,
CL = 100 pF,
(see Figure 2)
TMS320LC17
DIGITAL SIGNAL PROCESSOR
SPRS009C–JANUARY 1987–REVISED JULY 1991
POST OFFICE BOX 1443
HOUSTON, TEXAS 77001
122
timing requirements over recommended operating conditions
TEST CONDITIONS
MIN
NOM
MAX
UNIT
tsu(D)
Setup time data bus valid prior to CLKOUT
↓
80
ns
th(D)
Hold time data bus held valid after CLKOUT
↓
(see Note 9)
0
ns
NOTE 9: Data may be removed from the data bus upon MEN
↑
or DEN
↑
preceding CLKOUT
↓
.
RESET (RS) TIMING
switching characteristics over recommended operating conditions
PARAMETER
TEST CONDITIONS
MIN
NOM
MAX
UNIT
td11
tdis(R)
td12
td13
These values were derived from characterization data and not tested.
Delay time DEN
↑
, WE
↑
, and MEN
↑
from RS
1/2tc(C)+75
1/4tc(C)+75
ns
Data bus disable time after RS
ns
Delay time from RS
↓
to high-impedance SCLK
Delay time from RS
↓
to high-impedance DX1, DX0
200
200
ns
ns
timing requirements over recommended operating conditions
MIN
NOM
MAX
UNIT
tsu(R)
tw(R)
Reset (RS) setup time prior to CLKOUT (see Note 10)
85
ns
RS pulse duration
5tc(C)
ns
NOTE 10:
RS can occur anytime during a clock cycle. Time given is minimum to ensure synchronous operation.
INTERRUPT (EXINT) TIMING
timing requirements over recommended operating conditions
MIN
NOM
MAX
UNIT
tf(INT)
tw(INT)
tsu(INT)
Fall time EXINT
15
ns
Pulse duration EXINT
tc(C)
85
ns
Setup time EXINT
↓
before CLKOUT
↓
ns
I/O (BIO) TIMING
timing requirements over recommended operating conditions
MIN
NOM
MAX
UNIT
tf(IO)
tw(IO)
tsu(IO)
Fall time BIO
15
ns
Pulse duration BIO
tc(C)
85
ns
Setup time BIO
↓
before CLKOUT
↓
ns
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