參數(shù)資料
型號(hào)： TMS320C6424_1
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： Fixed-Point Digital Signal Processor
中文描述： 定點(diǎn)數(shù)字信號(hào)處理器
文件頁數(shù)： 212/245頁
文件大小： 1823K
代理商： TMS320C6424_1
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www.ti.com
6.15.2
EMAC Peripheral Register Description(s)
TMS320C6424
Fixed-Point Digital Signal Processor
SPRS347B–MARCH 2007–REVISED NOVEMBER 2007
Using the RMII Mode of the EMAC
The EMAC contains logic that allows it to communicate using the Reduced Media Independent Interface
(RMII) protocol. This logic must be taken out of reset before being used. To use the RMII mode of the
EMAC follow these guidelines:
Supply a 50 MHz reference clock to the RMREFCLK input pin.
The PINMUX1 register RMII bit field
must
be programmed to "1" to select the RMII pins and the RMII
mode of operation.
MACCONTROL.RMIISPEED
must
be programmed to the desired operating speed for the RMII
interface.
MACCONTROL.FULLDUPLEX
must
be programmed to "1", selecting full duplex mode for RMII.
Table 6-55. Ethernet MAC (EMAC) Control Registers
HEX ADDRESS RANGE
01C8 0000
01C8 0004
01C8 0008
01C8 0010
01C8 0014
01C8 0018
01C8 0080
01C8 0084
01C8 0088
01C8 008C
01C8 0090
01C8 00A0
01C8 00A4
01C8 00A8
01C8 00AC
01C8 00B0
01C8 00B4
01C8 00B8
01C8 00BC
01C8 0100
01C8 0104
01C8 0108
01C8 010C
01C8 0110
01C8 0114
01C8 0120
01C8 0124
01C8 0128
01C8 012C
01C8 0130
01C8 0134
01C8 0138
01C8 013C
01C8 0140
ACRONYM
TXIDVER
TXCONTROL
TXTEARDOWN
RXIDVER
RXCONTROL
RXTEARDOWN
TXINTSTATRAW
TXINTSTATMASKED
TXINTMASKSET
TXINTMASKCLEAR
MACINVECTOR
RXINTSTATRAW
RXINTSTATMASKED
RXINTMASKSET
RXINTMASKCLEAR
MACINTSTATRAW
MACINTSTATMASKED
MACINTMASKSET
MACINTMASKCLEAR
RXMBPENABLE
RXUNICASTSET
RXUNICASTCLEAR
RXMAXLEN
RXBUFFEROFFSET
RXFILTERLOWTHRESH
RX0FLOWTHRESH
RX1FLOWTHRESH
RX2FLOWTHRESH
RX3FLOWTHRESH
RX4FLOWTHRESH
RX5FLOWTHRESH
RX6FLOWTHRESH
RX7FLOWTHRESH
RX0FREEBUFFER
REGISTER NAME
Transmit Identification and Version Register
Transmit Control Register
Transmit Teardown Register
Receive Identification and Version Register
Receive Control Register
Receive Teardown Register
Transmit Interrupt Status (Unmasked) Register
Transmit Interrupt Status (Masked) Register
Transmit Interrupt Mask Set Register
Transmit Interrupt Mask Clear Register
MAC Input Vector Register
Receive Interrupt Status (Unmasked) Register
Receive Interrupt Status (Masked) Register
Receive Interrupt Mask Set Register
Receive Interrupt Mask Clear Register
MAC Interrupt Status (Unmasked) Register
MAC Interrupt Status (Masked) Register
MAC Interrupt Mask Set Register
MAC Interrupt Mask Clear Register
Receive Multicast/Broadcast/Promiscuous Channel Enable Register
Receive Unicast Enable Set Register
Receive Unicast Clear Register
Receive Maximum Length Register
Receive Buffer Offset Register
Receive Filter Low Priority Frame Threshold Register
Receive Channel 0 Flow Control Threshold Register
Receive Channel 1 Flow Control Threshold Register
Receive Channel 2 Flow Control Threshold Register
Receive Channel 3 Flow Control Threshold Register
Receive Channel 4 Flow Control Threshold Register
Receive Channel 5 Flow Control Threshold Register
Receive Channel 6 Flow Control Threshold Register
Receive Channel 7 Flow Control Threshold Register
Receive Channel 0 Free Buffer Count Register
Peripheral Information and Electrical Specifications
212
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PDF描述
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