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參數(shù)資料
| 型號： | SAA7381 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費家電 |
| 英文描述： | ATAPI CD-R block decoder |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP144 |
| 文件頁數(shù)： | 28/108頁 |
| 文件大?。?/td> | 380K |
| 代理商： | SAA7381 |
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1997 Aug 12
28
Philips Semiconductors
Objective specification
ATAPI CD-R block decoder
SAA7381
Table 37
mmdiv/mcksel relationship to clocks needed for I
2
S-bus and IEC 958
Notes
1.
For these combinations the duty factor of the output SCK2 clock is not necessarily 50%. These combinations are
therefore not recommended.
This is illegal but possible.
2.
Table 38
Description of the MMAUD register control bits
Note
1.
If enabled, data is written to the CDDA interface from a FIFO located in the CDDA register space. If either ‘daen’ = 1
or ‘iecen’ = 1 (ieccrtl), the interface will become active.
DIVIDER CODE
mmdiv
mcksel
I
2
S-BUS OUTPUT
IEC 958
I
2
S-BUS,
48 BITS PER
SAMPLE
I
2
S-BUS,
64 BITS PER
SAMPLE
MULTIMEDIA
CLOCK
OVERSAMPLE
48f
s
64f
s
96f
s
128f
s
192f
s
256f
s
384f
s
512f
s
768f
s
1024f
s
1536f
s
REQUIRED
FREQUENCY
(Hz)
2116800
2822400
4233600
5644800
8467200
11289600
16934400
22579200
33868800
45158400
67737600
n = 1
n = 2
n = 1
n = 2
n = 1
(n = 2)
0000
0001
0010
0011
0100
0101
0110
0111
1000
1001
1010
1
(1)
2
4
8
16
32
1
1
(1)
1.5
(1)
2
3
4
6
8
12
16
24
1
(1)
2
4
8
16
1
(1)
1.5
(1)
2
3
4
6
8
12
1.5
2
3
4
6
8
12
(1)
(1.5)
(2)
(2)
(3)
(4)
(6)
BIT
7
NAME
daen
(1)
VALUE
0
1
0
1
0
1
00
01
10
11
00
DESCRIPTION
CD-DA interface is off
CD-DA Interface is on
I
2
S-bus serial mode
EIAJ16 serial mode
I
2
S-bus is slave
I
2
S-bus is master
I
2
S-bus left channel output is left (default)
I
2
S-bus left channel output is right
I
2
S-bus left channel output is muted
reserved
I
2
S-bus right channel output is right (default). This is the opposite default to
left channel.
I
2
S-bus right channel output is left
I
2
S-bus right channel output is muted
reserved
6
eiaj
5
master
3
leftmode
2
1
rightmode
01
10
11
0
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PDF描述 |
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