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參數(shù)資料
| 型號： | PM2329 |
| 英文描述： | Telecommunication IC |
| 中文描述： | 通信集成電路 |
| 文件頁數(shù)： | 113/162頁 |
| 文件大?。?/td> | 1581K |
| 代理商： | PM2329 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁當(dāng)前第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁
Proprietary and Confidential to PMC-Sierra, Inc and for its Customers
’
Internal Use
Document ID: PMC-2010146, Issue 4
116
PM2329 ClassiPI Network Classification Processor Datasheet
required assuming FIFO addressing (all writes at the same address, except the EOP word) is to be used.
Note:
For 64-bit mode, the last 32 bits must be left justified (63:32) and the lower 32 bits (31:0) should be
padded with zeroes.
The next table shows the write cycles required when SRAM-like addressing is utilized.
Note that when using the SRAM like addressing to input the packet data (non EOP words), the lower
address bits (SA[7:3], or SA[7:2]) are don
’
t care whereas the EOP word address is fixed depending on the
Direction to be indicated (EOP D0 is Base 3 +0F8h; EOP D1 is Base 0 +08h [64 bit mode]). This allows
the packet data to be input using a block memory transfer mechanism where the destination address
increments. Packet data to be transferred with Direction set to 0 can be transferred efficiently using a single
block transfer--depending on the number of words to be transferred, the transfer can be started at the
appropriate starting offset such that the EOP word gets the last packet word.
For example, when operating in 64-bit mode, in order to transfer 256-bit packet (four 64-bit words) with
Direction set to 0, block transfer can be started at Base 3 +0E0h with a transfer count of 4. The first three
FIFO Addressing
Packet
Size
64 bits
64-bit
32-bit
Direction
0
1
0
1
Not EOP
EOP
None
Base 3
+0F8h
Base 3 +00h
Base 3
+0F8h
Base 3 +00h
Base 3
+0F8h
Base 3 +00h
Base 3
+0FCh
2x (Base 3 +00h)
Base 3
+0FCh
3x (Base 3 +00h)
Base 3
+0FCh
Base 0 +08h
Base 0
+0Ch
96 bits
Not EOP
EOP
(Note1)
Not EOP
EOP
Base 0 +08h
Base 0
+0Ch
128 bits
Base 0 +08h
Base 0
+0Ch
SRAM Addressing
Packet
Size
64 bits
64-bit
32-bit
Direction
0
1
0
1
Not EOP
None
Base 3 +any offset other
than 0FCh
Base 3
+0FCh
Base 3 +any offset other
than 0FCh
Base 3
+0FCh
Base 3 +any offset other
than 0FCh
Base 3
+0FCh
EOP
Base 3
+0F8h
Base 3 +any offset other
than 0F8h
Base 3
+0F8h
Base 3 +any offset other
than 0F8h
Base 3
+0F8h
Base 0 +08h
Base 0
+0Ch
96 bits
Not EOP
EOP
(Note1)
Not EOP
Base 0 +08h
Base 0
+0Ch
128 bits
EOP
Base 0 +08h
Base 0
+0Ch
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PDF描述 |
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