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參數(shù)資料
| 型號(hào)： | PDM41258SA7SO |
| 元件分類(lèi)： | SRAM |
| 英文描述： | 64K X 4 STANDARD SRAM, 7 ns, PDSO24 |
| 文件頁(yè)數(shù)： | 6/8頁(yè) |
| 文件大小： | 353K |
| 代理商： | PDM41258SA7SO |
PDM41258
6
Rev. 2.2 - 4/27/98
Write Cycle No. 1 (Write Enable Controlled)
Write Cycle No. 2 (Chip Enable Controlled)
AC Electrical Characteristics
SHADED AREA = PRELIMINARY DATA
Description
-7(6)
-8(6)
-10(6)
-12
-15
WRITE Cycle
Sym
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
Units
WRITE cycle time
tWC
7
8
101215
ns
Chip enable to end of write
tCW
7
8
101012
ns
Address valid to end of write
tAW
7
8
101012
ns
Address setup time
tAS
0
0000
ns
Address hold from end of write
tAH
0
0000
ns
Write pulse width
tWP
8
101011
ns
Data setup time
tDS
6
7778
ns
Data hold time
tDH
0
0000
ns
Write disable to output in low Z(4, 5)
tLZWE
0
0000
ns
Write enable to output in high Z(4, 5)
tHZWE
33333
ns
t WC
t AW
t CW
t AH
t
AS
t HZWE
HIGH Z
DATA VALID
t LZWE
t DS
t DH
ADDR
CE
t WP
WE
DIN
DOUT
tWC
t AW
tCW
t WP
t DS
DATA VALID
t DH
tAS
ADDR
DIN
UNDEFINED
DON'T CARE
t AH
CE
WE
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PDM41298SA20TI | 64K X 4 STANDARD SRAM, 20 ns, PDSO28 |
| PDM42245L25GI | 4K X 18 OTHER FIFO, CPGA68 |
| PDM44068SA5JI | 64K X 18 CACHE SRAM, PQCC52 |
| PDSP16350/B0/AC | 34-BIT, DSP-NUM CONTROLLED OSCILLATOR, CPGA84 |
| PDSP16488AMAACBR | 16-BIT, DSP-CONVOLVER, CPGA84 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PDM41258SA8SO | 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:x4 SRAM |
| PDM41258SA8SOI | 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:x4 SRAM |
| PDM41298LA10DI | 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:x4 SRAM |
| PDM41298LA10P | 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:x4 SRAM |
| PDM41298LA10PI | 制造商:未知廠(chǎng)家 制造商全稱(chēng):未知廠(chǎng)家 功能描述:x4 SRAM |
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