參數(shù)資料
型號： P9S12XEP100J1MAA
廠商： 飛思卡爾半導體(中國)有限公司
英文描述： Microcontrollers
中文描述： 微控制器
文件頁數(shù)： 311/1036頁
文件大?。?/td> 3356K
代理商： P9S12XEP100J1MAA
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Chapter 8 S12X Debug (S12XDBGV3) Module
MC9S12XE-Family Reference Manual Rev. 1.07
Freescale Semiconductor
311
8.3.2.3
Debug Trace Control Register (DBGTCR)
Read: Anytime
Write: Bits 7:6 only when S12XDBG is neither secure nor armed.
Bits 5:0 anytime the module is disarmed.
Address: 0x0022
7
6
5
4
3
2
1
0
R
W
TSOURCE
TRANGE
TRCMOD
TALIGN
Reset
0
0
0
0
0
0
0
0
Figure 8-5. Debug Trace Control Register (DBGTCR)
Table 8-9. DBGTCR Field Descriptions
Field
Description
7–6
TSOURCE
Trace Source Control Bits
— The TSOURCE bits select the data source for the tracing session. If the MCU
system is secured, these bits cannot be set and tracing is inhibited. See
Table 8-10
.
5–4
TRANGE
Trace Range Bits
— The TRANGE bits allow filtering of trace information from a selected address range when
tracing from the CPU12X in Detail Mode. The XGATE tracing range cannot be narrowed using these bits. To use
a comparator for range filtering, the corresponding COMPE and SRC bits must remain cleared. If the COMPE
bit is not clear then the comparator will also be used to generate state sequence triggers. If the corresponding
SRC bit is set the comparator is mapped to the XGATE buses, the TRANGE bits have no effect on the valid
address range, memory accesses within the whole memory map are traced. See
Table 8-11
.
3–2
TRCMOD
Trace Mode Bits
— See
Section 8.4.5.2
for detailed Trace Mode descriptions. In Normal Mode, change of flow
information is stored. In Loop1 Mode, change of flow information is stored but redundant entries into trace
memory are inhibited. In Detail Mode, address and data for all memory and register accesses is stored. See
Table 8-12
.
1–0
TALIGN
Trigger Align Bits
— These bits control whether the trigger is aligned to the beginning, end or the middle of a
tracing session. See
Table 8-13
.
Table 8-10. TSOURCE — Trace Source Bit Encoding
TSOURCE
Tracing Source
00
No tracing requested
01
10
1
11
1,2
CPU12X
1
No range limitations are allowed. Thus tracing operates as if TRANGE = 00.
2
No Detail Mode tracing supported. If TRCMOD = 10, no information is stored.
XGATE
Both CPU12X and XGATE
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