參數(shù)資料
型號： ORT82G5-3F680C
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 63/119頁
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描述： IC FPSC TRANSCEIVER 8CH 680-BGA
產(chǎn)品變化通告： Product Discontinuation 01/Aug/2011
標準包裝： 24
系列： *
Lattice Semiconductor
ORCA ORT42G5 and ORT82G5 Data Sheet
48
Figure 29. Receive Clocking for a Dual Alignment in a Single Quad (Similar Connections Would Be Used for
Quad B)
For receive quad alignment, RSYS_CLK_[A1,B1] and RSYS_CLK_[A2,B2] can be tied together as shown for quad
A and B in Figure 30. In receive eight-channel alignment, either RCK78A or RCK78B can be used to source
RSYS_CLK_[A1,A2] and RSYS_CLK_[B1,B2] as shown in Figure 31.
Figure 30. Clocking for Quad Alignment in a Single Quad (Similar Connections Would Be Used for Quad B)
Common Logic, Quad A
Channel AA
Channel AB
Channel AD
Channel AC
REFCLK[P:N]_A
2
156.25 MHz
RCK78A
RWCKAA
RWCKAC
RSYS_CLK_A1
RSYS_CLK_A2
FPGA
Logic
Two Bidirectional Channels
of 3.125 Gbps
Serial Data
RWCKAB
RWCKAD
All Clocks at
78.125 MHZ
TCK78A
TSYS_CLK_AA
TSYS_CLK_AB
TSYS_CLK_AC
TSYS_CLK_AD
Two Bidirectional Channels
of 3.125 Gbps
Serial Data
Common Logic, Quad A
Channel AA
Channel AB
Channel AD
Channel AC
REFCLK[P:N]_A
2
156.25 MHz
RCK78A
RWCKAA
RWCKAC
RSYS_CLK_A1
RSYS_CLK_A2
FPGA
Logic
Four Bidirectional Channels
of 3.125 Gbps
Serial Data
RWCKAB
RWCKAD
All Clocks at
78.125 MHZ
TCK78A
TSYS_CLK_AA
TSYS_CLK_AB
TSYS_CLK_AC
TSYS_CLK_AD
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PDF描述
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