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參數(shù)資料
| 型號： | NCN6000DTBR2G |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 19/36頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC INTERFACE SMART CARD 20TSSOP |
| 產(chǎn)品變化通告： | Product Obsolescence 01/Jul/2009 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 應(yīng)用： | ATM 終端，氣泵，ISM |
| 接口： | 微控制器 |
| 電源電壓： | 2.7 V ~ 6 V |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 20-TSSOP |
| 包裝： | 剪切帶 (CT) |
| 安裝類型： | 表面貼裝 |
| 其它名稱： | NCN6000DTBR2GOSCT |
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NCN6000
http://onsemi.com
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The example given by the oscillogram here above
highlights the delay coming from the internal clock duty
cycle resynchronization. In this example, the clock is
internally divided by 2 prior to be applied to the CRD_CLK
pin. Since the clock signal is asynchronous, it is up to the
programmer to make sure the next card transaction is not
activated before the CRD_CLK signal has been updated.
Generally speaking, such a delay can be derived from the
maximum clock frequency provided to the interface,
keeping in mind the maximum delay is eight incoming clock
pulses.
Figure 25. Clock Programming Examples
The clock can be reprogrammed without halting the rest
of the circuit, whatever be the new clock divider ratio. In
particular, the CRD_VCC can be applied to the card while
the clock is reprogrammed.
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PDF描述 |
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參數(shù)描述 |
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