Figure 24 shows the signal behavior of the <" />
參數(shù)資料
型號(hào)： MSC7119VM1200
廠商： Freescale Semiconductor
文件頁數(shù)： 31/60頁
文件大?。?/td> 0K
描述： DSP 16BIT W/DDR CTRLR 400-MAPBGA
標(biāo)準(zhǔn)包裝： 90
系列： StarCore
類型： 定點(diǎn)
接口： 主機(jī)接口，I²C，UART
時(shí)鐘速率： 300MHz
非易失內(nèi)存： ROM（8 kB）
芯片上RAM： 464kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.20V
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 400-LFBGA
供應(yīng)商設(shè)備封裝： 400-MAPBGA（17x17）
包裝： 托盤
MSC7119 Data Sheet, Rev. 8
Freescale Semiconductor
37
2.5.9
UART Timing
2.5.10
EE Timing
Figure 24 shows the signal behavior of the EE pin.
Table 27. UART Timing
No.
Characteristics
Expression
Min
Max
Unit
—
Internal bus clock (APBCLK)
FCORE/2
—
150
MHz
—
Internal bus clock period (1/APBCLK)
TAPBCLK
6.67
—
ns
400
URXD and UTXD inputs high/low duration
16
× TAPBCLK
106.67
—
ns
401
URXD and UTXD inputs rise/fall time
—
5
ns
402
UTXD output rise/fall time
—
5
ns
Figure 21. UART Input Timing
Figure 22. UART Output Timing
Table 28. EE0 Timing
Number
Characteristics
Type
Min
65
EE0 input to the core
Asynchronous
4 core clock periods
66
EE0 output from the core
Synchronous to core clock
1 core clock period
Notes:
1.
The core clock is the SC1400 core clock. The ratio between the core clock and CLKOUT is configured during power-on-reset.
2.
Configure the direction of the EE pin in the EE_CTRL register (see the SC140/SC1400 Core Reference Manual for details.
3.
Refer to Table 1-11 on page 1-16 for details on EE pin functionality.
Figure 23. EE Pin Timing
UTXD, URXD
400
inputs
400
401
UTXD Output
402
EE0 In
65
EE0 Out
66
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PDF描述
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