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參數(shù)資料
| 型號(hào)： | ML66Q517-NGA |
| 廠商： | OKI ELECTRIC INDUSTRY CO LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 14 X 20 MM, 0.80 MM PITCH, PLASTIC, QFP-80 |
| 文件頁數(shù)： | 373/424頁 |
| 文件大小： | 1922K |
| 代理商： | ML66Q517-NGA |
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ML66517 Family User’s Manual
Chapter 2
CPU Architecture
2 – 22
2.3.5 Segment Registers
There are two 8-bit segment registers: the code segment register (CSR) and the table segment register (TSR).
These registers select segments in the program memory space.
The segment registers are included only in the ML66517/ML66Q517 and not included in the ML66Q515/
ML66514.
However, since the program memory space has only segments 0 and 1, only bit 0 is valid.
Bits 1 to 7 are fixed
to “0”.
(1) Code segment register (CSR)
CSR specifies the segment in program memory space to which the program code currently being executed
belongs. CSR exists as an independent 8-bit register and is not assigned to the SFR area. The CSR contents
can be overwritten by FJ, FCAL, VCAL, FRT and RTI instructions and interrupts. No other methods can be
used to overwrite the contents of CSR. For FJ and FCAL instructions, use branch destination addresses that
are within segments 0 and 1.
Each segment is assigned an internal segment offset address of 0 to 0FFFFH. The address calculation to
determine the addressed target is performed with a 16-bit offset address and any resulting overflow or
underflow is ignored so that CSR does not change. Similarly, overflow of the PC never updates the CSR.
Therefore, without the use of the CSR overwrite method described above, program execution does not
advance beyond the code segment boundary. The CSR value at reset is 00H.
When an interrupt occurs after program memory space has been expanded to 128KB, both the current CSR
value and the PC are automatically saved on the stack. Executing a RTI instruction restores the saved value
to CSR. (Refer to Section 2.2.1, “Memory Space Expansion”.)
(2) Table segment register (TSR)
TSR specifies the segment in program memory to which the table data belongs. TSR is an 8-bit register and
is assigned to the SFR area. The contents of TSR can be overwritten by instructions that use SFR
addressing.
Data in the table segment can be accessed by using ROM reference instructions (LC, LCB,
CMPC and CMPCB). If the ROM window function is used, RAM addressing can be utilized for this table
segment.
Only bit 1 of TSR is valid. If read, a value of “0” will be obtained for bits 1 to 7. If writing to
TSR, “0” must be written to bits 1 to 7.
Each segment is assigned an internal segment offset address of 0 to 0FFFFH. The address calculation to
determine the addressed target is performed with a 16-bit offset address and any resulting overflow or
underflow is ignored, so TSR does not change. The TSR value at reset is 00H.
“0”
7
6
5
4
3
2
1
0
CSR
At reset
0
“0”
7
6
5
4
3
2
1
0
TSR
At reset
0
“0” indicates that a value of “0” must be written.
If read, a value of “0” will be obtained.
Address: 0008 [H]
R/W access: R/W
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