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參數(shù)資料
| 型號： | MC68HC705C9ACP |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Microcontrollers |
| 中文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PDIP40 |
| 封裝： | PLASTIC, DIP-40 |
| 文件頁數(shù)： | 82/160頁 |
| 文件大?。?/td> | 2076K |
| 代理商： | MC68HC705C9ACP |
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Capture/Compare Timer
Advance Information
MC68HC705C9A — Rev. 4.0
82
Capture/Compare Timer
For More Information On This Product,
Go to: www.freescale.com
MOTOROLA
8.4.6 Output Compare Registers
When the value of the 16-bit counter matches the value in the output
compare registers (OCRH and OCRL), the planned TCMP pin action
takes place. Writing to OCRH before writing to OCRL inhibits timer
compares until OCRL is written. Reading or writing to OCRL after the
timer status register clears the output compare flag (OCF).
Figure 8-7. Output Compare Registers (OCRH and OCRL)
To prevent OCF from being set between the time it is read and the time
the output compare registers are updated, use this procedure:
1.
Disable interrupts by setting the I bit in the condition code register.
2.
Write to OCRH. Compares are now inhibited until OCRL is written.
3.
Clear bit OCF by reading timer status register (TSR).
4.
Enable the output compare function by writing to OCRL.
5.
Enable interrupts by clearing the I bit in the condition code register.
OCRH
$0016
Bit 7
6
5
4
3
2
1
Bit 0
Write:
Bit 15
Bit 14
Bit 13
Bit 12
Bit 11
Bit 10
Bit 9
Bit 8
Read:
Reset:
Unaffected by reset
OCRL
$0017
Bit 7
6
5
4
3
2
1
Bit 0
Read:
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Write:
Reset:
Unaffected by reset
F
Freescale Semiconductor, Inc.
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC705P6A | HCMOS Microcontroller Unit |
| MC68HC705P6ACDW | HCMOS Microcontroller Unit |
| MC68HC705P6ACP | HCMOS Microcontroller Unit |
| MC68HC912D60A | Microcontrollers |
| MC68HC912D60C | Microcontrollers |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| MC68HC705E6CDW | 制造商:Motorola Inc 功能描述: 制造商:MOTOROLA 功能描述: |
| MC68HC705G1B | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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