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參數(shù)資料
| 型號： | M37721 |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | 16-Bit Single-Chip Microcomputer(16位單片微控制器) |
| 中文描述： | 16位單片機(jī)（16位單片微控制器） |
| 文件頁數(shù)： | 290/576頁 |
| 文件大?。?/td> | 6745K |
| 代理商： | M37721 |
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7721 Group User’s Manual
13-12
DMA CONT R OLLE R
13.2 Block description
13.2.4 Source address register i (SARi)
Source address register i (hereafter called SARi) is a 24-bit register with a latch.
SARi indicates the transfer source address of the data to be transferred next.
The SARi latch has the following functions:
Maintains the value written to the address of SARi (in the single transfer and repeat transfer modes).
Indicates the start address of the transfer parameter memory of the next block (in the array chain
transfer and link array chain transfer modes).
When a value is written into the address of SARi, the same value is written into SARi and the SARi latch.
When writing a value to the address of SARi, all 24 bits must be written.
The contents of SARi can be read by reading the address of SARi; however, the value of the SARi latch
cannot be read. (Refer to
“Tables 13.2.4 and 13.2.5.”
)
13.2.5 Destination address register i (DARi)
Destination address register i (hereafter called DARi) is a 24-bit register with a latch.
DARi indicates the transfer destination address of the data to be transferred next.
The DARi latch maintains the value written to the address of DARi.
When a value is written into the address of DARi, the same value is written into DARi and the DARi latch.
When writing a value to the address of DARi, all 24 bits must be written.
The contents of DARi can be read by reading the address of DARi; however, the value of the DARi latch
cannot be read. (Refer to
“Tables 13.2.4 and 13.2.5.”
)
13.2.6 Transfer counter register i (TCRi)
Transfer counter register i (hereafter called TCRi) is a 24-bit register with a latch.
TCRi indicates the number of remaining bytes of the block under transfer.
The TCRi latch has the following functions:
Maintains the value written to the address of TCRi (in the single transfer and repeat transfer modes).
Indicates the number of remaining blocks (in the array chain transfer mode).
When a value is written into the address of TCRi, the same value is written into TCRi and the TCRi latch.
When writing a value to the address of TCRi, all 24 bits must be written.
The contents of TCRi can be read by reading the address of TCRi; however, the value of the TCRi latch
cannot be read. (Refer to
“Tables 13.2.4 and 13.2.5.”
)
Table 13.2.4 Addresses of SARi, DARi, and TCRi
Source address register i
Channel
0
1
2
3
(SARi)
1FC2
16
–1FC0
16
1FD2
16
–1FD0
16
1FE2
16
–1FE0
16
1FF2
16
–1FF0
16
Destination address
register i (DARi)
1FC6
16
–1FC4
16
1FD6
16
–1FD4
16
1FE6
16
–1FE4
16
1FF6
16
–1FF4
16
1FCA
16
–1FC8
16
1FDA
16
–1FD8
16
1FEA
16
–1FE8
16
1FFA
16
–1FF8
16
Transfer counter register i
(TCRi)
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PDF描述 |
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