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參數(shù)資料
| 型號： | M34554MC-XXXFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, MROM, 6 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 14 X 14 MM, 0.80 MM PITCH, PLASTIC, QFP-64 |
| 文件頁數(shù)： | 86/137頁 |
| 文件大?。?/td> | 1606K |
| 代理商： | M34554MC-XXXFP |
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52
4554 Group
SINGLE-CHIP 4-BIT CMOS MICROCOMPUTER
MITSUBISHI MICROCOMPUTERS
Fig. 39 Power-on reset circuit example
Name
D0–D6
D7/CNTR0
D8/INT0, D9/INT1
P00–P03
P10–P13
SEG31/P20–SEG28/P23
SEG27/P30–SEG24/P33
SEG0/VLC3–SEG2/VLC1
SEG3–SEG23
COM0–COM3
C/CNTR1
Notes 1: Output latch is set to “1.”
2: Output structure is N-channel open-drain.
3: Pull-up transistor is turned OFF.
Function
D0–D6
D7
D8, D9
P00–P03
P10–P13
SEG31–SEG28
SEG27–SEG24
SEG0–SEG2
SEG3–SEG23
COM0–COM3
C
State
High-impedance (Notes 1, 2)
High-impedance (Note 1)
High-impedance (Notes 1, 2, 3)
VLC3 (VDD) level
“L” (VSS) level
(1) Power-on reset
Reset can be automatically performed at power on (power-on re-
set) by the built-in power-on reset circuit. When the built-in
power-on reset circuit is used, the time for the supply voltage to
rise from 0 V must be set to 100
s or less. If the rising time ex-
ceeds 100
s, connect a capacitor between the RESET pin and
VSS at the shortest distance, and input “L” level to RESET pin until
the value of supply voltage reaches the minimum operating volt-
age.
Table 13 Port state at reset
RESET pin
WEF
Watchdog reset signal
(Note 1)
Pull-up transistor
(Note 1)
Power-on reset circuit
Voltage drop detection circuit
VDD (Note 3)
100
s or less
(Note 2)
Internal reset signal
Power-on
Reset released
Internal reset signal
Reset
state
Notes 1:
This symbol represents a parasitic diode.
2: Applied potential to RESET pin must be VDD or less.
3: Keep the value of supply voltage to the minimum value
or more of the recommended operating conditions.
Power-on reset circuit output
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