參數(shù)資料
型號(hào)： LFSCM3GA80EP1-6FCN1704C
廠商： LATTICE SEMICONDUCTOR CORP
元件分類： FPGA
中文描述： FPGA, 308 CLBS, 80000 GATES, 1000 MHz, CBGA1704
封裝： 42.5 X 42.5 MM, LEAD FREE, CERAMIC, FCBGA-1704
文件頁(yè)數(shù)： 185/243頁(yè)
文件大?。?/td> 2674K
代理商： LFSCM3GA80EP1-6FCN1704C
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3-2
DC and Switching Characteristics
Lattice Semiconductor
LatticeSC/M Family Data Sheet
Power Supply Ramp Rates
Hot Socketing Specifications
1
DC Electrical Characteristics
5
Over Recommended Operating Conditions
Symbol
Parameter
Condition
Min.
Typ.
Max
Units
tRAMP
Power supply ramp rates for all power supplies
Over process, voltage,
temperature
3.45
—
mV/s
——
75
ms
1. See the Power-up and Power-Down requirements section for more details on power sequencing.
2. From 0.5V to minimum operating voltage.
Symbol
Parameter
Condition
Min.
Typ.
Max
Units
IDK
Programmable and dedicated Input or I/O leakage
current
2, 3, 4, 5, 6
0 <= VIN <= VIH (MAX)
—
±1500
A
IHDIN
SERDES average input current when device powered
down and inputs driven
7
——
4
mA
1. See Hot Socket power up/down information in Chapter 2 of this document.
2. Assumes monotonic rise/fall rates for all power supplies.
3. Sensitive to power supply sequencing as described in hot socketing section.
4. Assumes power supplies are between 0 and maximum recommended operations conditions.
5. IDK is additive to IPU, IPD or IBH.
6. Represents DC conditions. For the first 20ns after hot insertion, current specification is 8 mA.
7. Assumes that the device is powered down with all supplies grounded, both P and N inputs driven by a CML driver with maximum allowed
VDDOB of 1.575V, 8b/10b data and internal AC coupling.
Symbol
Parameter
Condition
Min.
3
Typ.
Max.
Units
IIL, IIH
1
Input or I/O Low leakage
0
V
IN VIH (MAX)
—
10
A
IPU
I/O Active Pull-up Current 0
V
IN 0.7 VCCIO
-30
—
-210
A
IPD
I/O Active Pull-down Cur-
rent
VIL (MAX) VIN VIH (MAX)
30
—
210
A
IBHLS
Bus Hold Low Sustaining
Current
VIN = VIL (MAX)
30
—
A
IBHHS
Bus Hold High Sustaining
Current
VIN = 0.7VCCIO
-30
—
A
IBHLO
Bus Hold Low Overdrive
Current
0
V
IN VIH (MAX)
—
210
A
IBHLH
Bus Hold High Overdrive
Current
0
V
IN VIH (MAX)
—
-210
A
ICL
PCI Low Clamp Current
-3 < VIN -1
-25 + (VIN + 1)/0.015
—
mA
ICH
PCI High Clamp Current
VCC + 4 > VIN VCC + 1
25 + (VIN - VCC -1)/
0.015
——
mA
VBHT
Bus Hold trip Points
0
V
IN VIH (MAX)
VIL (MAX)
—
VIH (MIN)
V
C1
I/O Capacitance
2
VCCIO = 3.3V, 2.5V, 1.8V, 1.5V, 1.2V,
VCC = 1.2V, VCCIP2 = 1.2V,
VCCAUX = 2.5, VIO = 0 to VIH (MAX)
—8
—
pf
C3
2
Dedicated Input
Capacitance
2
VCCIO = 3.3V, 2.5V, 1.8V, 1.5V, 1.2V,
VCC = 1.2V, VCCIP2 = 1.2V,
VCCAUX = 2.5, VIO = 0 to VIH (MAX)
—6
—
pf
1. Input or I/O leakage current is measured with the pin configured as an input or as an I/O with the output driver tri-stated. It is not measured
with the output driver active. Bus maintenance circuits are disabled.
2. TA 25°C, f = 1.0MHz
3. IPU, IPD, IBHLS and IBHHS have minimum values of 15 or -15A if VCCIO is set to 1.2V nominal.
4. This table does not apply to SERDES pins.
5. For programmable I/Os.
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PDF描述
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LFSCM3GA40EP1-5FFN1020I
LFXP2-40E-6FN484I
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參數(shù)描述
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LFSCM3GA80EP1-6FF1152C 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 80.1K LUTs 660 I/O MACO SERDES1.2V -6SP RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
LFSCM3GA80EP1-6FF1152I 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 80.1K LUTs 660 I/O MACO SERDES1.2V -6SP RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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